CN107564959B 一种mos栅控晶闸管及其制作方法 (电子科技大学).docxVIP

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  • 2026-03-08 发布于重庆
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CN107564959B 一种mos栅控晶闸管及其制作方法 (电子科技大学).docx

(19)中华人民共和国国家知识产权局

(12)发明专利

(45)授权

(10)授权公告号CN107564959B公告日2020.10.27

(21)申请号201710761364.5

(22)申请日2017.08.30

(65)同一申请的已公布的文献号申请公布号CN107564959A

(43)申请公布日2018.01.09

(73)专利权人电子科技大学

地址611731四川省成都市高新西区西源

大道2006号

H01L29/749(2006.01)

H01L21/332(2006.01)

(56)对比文件

US5793066A,1998.08.11

CN104393034A,2015.03.04US5198687A,1993.03.30

JP特开平2-12969A,1990.01.17

审查员郑钰

(72)发明人陈万军夏云刘超高吴昊左慧玲邓操

(74)专利代理机构成都点睛专利代理事务所(普通合伙)51232

代理人孙一峰

(51)Int.CI.

HO1L29/745(2006.01)权利要求书2页说明书4页附图12页

(54)发明名称

一种MOS栅控晶闸管及其制作方法

(57)摘要

CN107564959B本发明涉及功率半导体技术,特别涉及一种MOS控制晶闸管及其制作方法。本发明对常规MCT的阴极以及栅极区进行改造,通过在栅下增加薄的P型半导体层,使得器件在栅上不加电压器件正向阻断时,P+阳极注入空穴形成的空穴漏电流能通过P型短路结构抽走,使器件实现耐压。正向导通时,在栅上加正电压时,P型半导体层反型形成电子沟道,N型半导体源区和中的电子进漂移区内,由P+阳极、漂移区、P型基区和N型源区构成的左侧PNPN晶闸管与右侧P+阳极、漂移区、P型基区和N型源区构成的右侧PNPN晶闸管接连发生闩锁,器件获得低的导通电阻,以及导通时不存在snapback现象。本发明的阴极PN结两层结构使用双重扩散工艺,与传统

CN107564959B

11

CN107564959B权利要求书1/2页

2

1.一种MOS栅控晶闸管,其元胞结构包括阳极结构、漂移区结构、阴极结构和栅极结构;所述阳极结构包括P+阳极(2)和位于P+阳极(2)下表面的阳极金属(1);所述漂移区结构包括位于P+阳极上表面的N型漂移区(3);所述阴极结构包括第一阴极结构和第二阴极结构;所述第一阴极结构由第一阴极金属(14)、第一N型半导体源区(13)和第一P型半导体基区(12)构成;所述第一P型半导体基区(12)设置在N型漂移区(3)顶部的一侧;所述第一N型半导体源区(13)设置在第一P型半导体基区(12)上,其上表面与第一阴极金属(14)相连;所述第二阴极结构由第二阴极金属(10)、第二N型半导体源区(5)、P型短路区(11)、第二P型半导体基区(4)构成;所述第二P型半导体基区(4)设置在N型漂移区(3)顶部的另一侧;所述第二N型半导体源区(5)和P型短路区(11)设置在第二P型半导体基区(4)上;所述第二阴极金属(10)位于第二N型半导体源区(5)和P型短路区(11)的上表面;所述栅极结构位于N型漂移区(3)顶部以及第一、第二阴极结构之间,由栅氧化层(8)、位于栅氧化层(8)下方的薄P型半导体区(15)和位于栅氧化层(8)顶部的多晶硅栅极(9)构成,栅极结构的下表面覆盖第一P型半导体基区(12)的上表面、第二P型半导体基区(4)的上表面和部分第二N型半导体源区(5)的上表面;其特征在于,第一P型半导体基区(12)通过薄P型半导体区(15)与第二P型半导体基区(4)相连接。

2.一种用于如权利要求1所述的MOS栅控晶闸管的制作方法,其特征在于,包括以下步骤:

第一步:在硅片衬底上制作结终端,形成N型漂移区(3);

第二步:在N型漂移区(3)上表面通过热氧化形成氧化层(16);

第三步:在N型漂移区(3)上层两侧注入P型杂质并推结形成第一P型半导体基区(12)和第二P型半导体基区(4);

第四步:在N型漂移区(3)上层注入N型杂质形成第一N型半导体源区(13)和第二N型半导体源区(5);第二N型半导体源区(

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