思考与练习
2.1VerilogHDL模块由哪些主要部分组成?各部分的主要作用是什么?
解答:VerilogHDL模块由模块声明、端口定义、内部线网/变量定义和功能描述等多个部分构成。其基本结构定义如下:
module模块名(端口列表);//模块声明
//端口定义
input[数据类型][位宽]输入端口列表;
output[数据类型][位宽]输出端口列表;
inout[数据类型][位宽]双向端口列表;
//参数定义
parameter/localparam参数名,…;
//内部线网/变量定义
wire[位宽]线网名,…;
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