实验九___加法器.pptVIP

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2017-09-26 发布于山西
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实验九___加法器.ppt

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实验九加法器实验内容 1、用门电路设计一个半加器，连线并验证其逻辑功能； 2、用门电路设计一个全加器，连线并验证其逻辑功能； 1.用门电路设计一个半加器 2. 用门电路设计一个全加器两数相加时，除Ai、Bi相加外，还要加上低位的进位数Ci?1。实验设备与器材数字逻辑电路IC扩展板； 74LS86（四2输入异或门）； 74HC08（四2输入与门）； 74LS32（四2输入或门） * 实验九加法器 1．验证半加器和全加器电路的逻辑功能； 2．熟悉中规模集成电路数据选择器的工作原理与逻辑功能； 3．了解数据选择器的应用。实验目的半加器的电路图和电路符号向高位的进位数半加和半加器：只求A、B的和，不管低位来的进位。（1）列真值表（2）由真值表写逻辑表达式 74LS86 1 2 3 74HC08 1 2 3 （3）作逻辑图（4）验证逻辑功能全加和进位数（1）列真值表（2）由真值表写逻辑表达式（3）作逻辑图（4）验证逻辑功能 74LS86 1 2 3 74HC08 1 2 3 74LS86 4 5 6 74HC08 4 5 6 74LS32 1 2 3 补充内容： 1、设计半减器 2、设计全减器 3、要求列出真值表，写出逻辑表达式，画出逻辑图实验报告要求：写出完整的设计过程，且条理清楚