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毕业设计(论文)外文资料翻译
系 别: 光电信息系
专 业: 测控技术与仪器
班 级: b90102
姓 名: 欧阳青
学 号:
外文出处:Science and Information Application Technology
附 件: 1. 原文; 2. 译文
2013年3月
Research of Frequency Divider Based on Programmable
Logic Device
Silesian University of Technology Institute Gliwice, Poland
Abstract
The design method of general integer and half-integer frequency divider circuits is introduced in this paper. It applies the module and parameterized idea, which can be realized under the CPLD developing platform. According to modifying the specific parameters, it can be applied to the different occasions. The experiment simulation and the result of the apparatus testing all get good effect. The generality of this design is good. It can be used into the designs of diverse digital circuit systems.
keywords: programmable logic levice; VHDL; half-integer frequency divider; integer frequency divider
Keywords:programmable logic levice;VHDL;half-integer frequency divider;
Integer frequency divider.
1. Introduction
In CPLD design, in order to give more generality to design production, parameterized design approach is often adopted during design【1】. What is called parameterization is to design some parameters as variables, in this way we can assign these parameters a value based on need and meet needs of different occasions【2】. By the help of parameterized design philosophy, VHDL hardware description language, schematic diagram input method, and through MAXPLUS II development platform, we use Alteras CPLD device to design and implement a quite general half-integer and integer frequency dividers【3】.
2. basic principle of frequency divider
In design of digital circuit, clock pulse of all frequencies is often indispensable. If we have
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