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powered by dlut ee 什么是 AHDL Altera Hardware Description Language 由 Altera公司开发 集成到Altera的软件 Max+Plus II 用语言描述硬件来代替图形 修改更容易 易于维护 非常适合于 复杂的组合逻辑 BCD 到 7段转换 地址解码 状态机 其他你想要的…… 继续... 容易掌握 支持图形文件 .gdf 支持文本文件 .tdf 支持波形文件 .wdf 丰富的函数库资源 MAXPLUSII的自动设计功能 更方便对AHDL设计文件进行编辑、编译和调试 自动对设计中的各种错误进行定位 文本设计文件的结构 怎样用ADHL 用任何文本编辑器建立这个文件 Altera 软件 Max+Plus II 提供文本编辑器 继续….. 用 name.TDF保存你的ADHL文件 继续... 编译期间的错误定位 方便的错误定位 通常的AHDL格式 你的第一个AHDL设计 – 地址解码器 为什么我用AHDL代替图形 容易编辑 Document during the coding 我想解码 H”A” 不是 H”7” 其他 需要你知道的一些事情 加 : + 减 : - 数字恒等 : == 不等于 : != 大于 : 大于或等于 : = 小于 : 小于或等于 : = 逻辑或 : # 逻辑与 : 用常数函数 如果相同的数值，字符串或数学表达式在一个文件出现几次就用常数 优点 被改变只需声明一次 实现组合逻辑 定义NODEs既中间节点或变量 总线操作 总线操作的更多内容 总线操作 a[] = b[]; a[9..0], b[9..0] a[7..4] = b[9..6]; a[9..8] = VCC; a[9..8] = 1; a[9..8] = 2; a[9..8] = 3; a[3..0] = GND a[3..0] = 0; temp = b0 b1; a[2..1] = temp 高级总线操作 总线Bus b[3..0] b3, b2, b1, b0 (有四个成员) ，最多256个成员 MSB 是 b3, LSB 是b0 默认值 也可以用OPTION语句进行设置 OPTION BITO=MSB 则MSB是b0 LSB是b3 阵列ARRAY BUS a[3..0][2..0] a3_2, a3_1, a3_0, a2_2, a2_1, a2_0, a1_2, a1_1, a1_0, a0_2, a0_1, a0_0 (有12个成员） MSB 是 a3_2, LSB 是 a0_0 真值表 i[3..0] 7 Segment 0 0 1 1 2 2 F F IF-THEN-ELSE CASE 段 For 循环 寄存器逻辑 更多的细节 寄存器的更多内容 怎样和寄存器一起使用总线 怎样使用其他触发器 DFFE (D-FF带使能端) TFF/TFFE JKFF/JKFFE SRFF/SRFFE 寄存器总线 D触发器带使能Enable/重设Preset/清除Clear 其他类型的触发器 如何用帮助菜单 Q : 我不知道Altera DFF/JKFFE……, 怎么办? A : Altera帮助菜单是查找信息的好地方。 Q : 我怎样用帮助菜单? A :这个很容易………… 很有趣。 怎样用帮助菜单 三态缓冲器 OPNDRN - Open Drain Buffer缓冲器 设计三态双向缓冲器 设计8 位计数器很容易 状态机 仿真结果 关于状态机更多内容 仿真结果 训练 状态机没有恢复态 Better have Recover within State Machine 何时使用AHDL 当门数和设计目标很复杂需要混合编程 .tdf .gdf .wdf 当设计目标要高速和优化 时间很紧 EDA技术初学者。 SUBDESIGN 8bits (clk : input; q[7..0] : output; ) variable temp[7..0] : dff; begin temp[].clk = clk; temp[].d = temp[].q +1 ; q[] = temp[].q; end; SUBDESIGN simple ( clk, reset, jump : input; q : output; ) variable ss : MACHINE WI