开发硬件/软件兼备嵌入式系统的挑战.pdfVIP

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维普资讯 OnlineSeminarHighlights ■ 呦 公司6月23日在线座谈 Altera公司是全球主要的可编程单芯片 (SOPC)方案的供应 现很多不同的逻辑功能,包括Nios}I软核CPU。 商。Altera把可编程逻辑技术和软件工具、IP和技术服务结合在 问:在Cyclone的EP1C2OF40oI8中跑Nios,能跑多快?或者 一 起,为全球大约14,000个客户提供可编程方案。 说,能实现什么样的系统?能否举个实例? 这次在线座谈将主要介绍如何使用NiosII软核处理器和 答:一般来说,Nios~以达到5ODMIPS,Nios}I可以达到 SoPCBuilder设计工具在可编程芯片上便捷地创建一个定制的嵌 15ODIMIPS,如果采用加速指令,可以达到200左右。lc2018是没 入式系统,以及如何创建灵活和恰好满足要求的嵌入式处理器,如 有这个型号的。C8/或 I7一般完成70—80M的设计没有问题。 何迅速地适应变化的标准或设计需求,如何远程进行功能升级和 我们实际设计5OM的都没有用CUSTOMER}NSTRUCTION,没 产品增强,如何运用用户定义的指令加速软件算法和如何避免处 有 问题。 理器过时淘汰。 问:还是上面提到的接 口,我希望是从配置芯片启动,把 Nios代码布到FPGA中,然后跑Nios程序,可否实现及如何实 现? 答:如果你希望从配置芯片启动Nios是可以的,你可以先利 用FPGA的片内的存储器实现一段BoatLoad代码,在FPGA~置 好之后,执行这段BoatLoad代码,然后开始执行配置芯片内的程 问:NiosII可以直接对IDE或SCSI接口的硬盘直接进行读写 序即可。 吗?如果可以,如何操作? 问:如何解决高速器件与低速器件之间的数据传输? 答:为使NioslI访问IDE/SCSI器件,需在Avalon总线上设 答:普通的FPG 殳计,可在两个器件中间加缓冲器,如:FIFO 置IDE或SCSI界面,或用软件在PIO口上模拟。我们开发板上的 DPRAM。在设计Nios时,Nios中的Avlone总线可以可直接帮你 CompactFlash可以连接 IDEinterface。 解决问题。 问:NiosII和Nios第一代相比,对于实时操作系统的支持有 问:在FPGAI~软件和硬件如何联合仿真,是否能简要介绍 哪些方面的改进? 一 下? 答:Niosll的开发套件内已经免费提供了一个uc/os—II的实

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