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大规模数字集成电路设计第三讲VHDL构造体的描述(1)描述方式操作符 ReviewVHDL程序组成部分及其功能 Review  VHDL程序的基本构成格式 本章要点 构造体：是VHDL程序中最复杂的部分。构造体设计是VHDL程序设计的重点。 构造体主要有三种描述方式： 行为描述、RTL描述、结构描述。 深入理解本章举例，理解行为描述、RTL描述以及结构描述分别的特点。 VHDL 构造体的描述方式 行为（ Behavioral）描述方式 寄存器传输（RTL）或数据流（Data-Flow）描述方式 结构化（Structural）描述方式 多层次的设计 直接用门电路单元搭建 构造体的行为（Behavioral）描述方式 基于系统数学模型或系统工作原理 抽象程度高，不能进行逻辑综合(Logic Synthesis) 设计复杂的或新的电子系统初，进行行为级描述 用于保护设计者的知识产权(e.g) 国家863超大规模集成电路设计SOC专项“可编程逻辑器件核及其编译开发” ＊该项目研制出国内第一颗复杂可编程逻辑器件CPLD，填补国内空白； 于2002.1-2003.12，国家863计划SOC专项资助下研制出具有72个宏单元的CPLD芯片(集成度为15万门)，2004年通过部级鉴定，2005年获国防科技进步三等奖。 T Region is a flash IP(0.35 um, 2P3M)It was provided by the foundryWe, CPLD designer, could use it in the simulation, but we could not see it. s?20% f?40% 【例3-1】一个五端口电路如图3-2所示。我们希望它具有如表3-1所示的功能，问如何通过行为级描述来得到它的输入输出波形。 x sum y cin cout 图3-2 五端口电路 表3-1此五端口逻辑电路功能表 ENTITY five_ports_circuit IS PORT (x,y,cin：IN std_logic ； sum,count：OUT std_logic)； END five_ports_circuit； ARCHITECTOR behavioral_view OF five_ports_circuit IS BEGIN PROCESS VARIABLE n ：INTEGER； CONSTANT sum_vector ：BIT_VECTOR(0 TO 3) ：=“0101”； CONSTANT carry_vector ：BIT_VECTOR(0 TO 3) ：=“0011”； BEGIN WAIT ON x, y,cin； n ：=0； IF x =’1’ THEN n ：=n+1； END IF； IF y =’1’ THEN n ：=n+1； END IF； IF cin =’1’ THEN n ：=n+1； END IF； sum =sum_vector (n) ； cout =carry_vector (n) ； END PROCESS； END behavioral_view； 表3.2 构造体的RTL描述方式 RTL描述方式是一种使用寄存器实现数据传递的描述方法，它能够表明寄存器之间的联结关系和数据流向或电路功能，它必须是可综合的。 前述5端口电路描述是不可综合的，因此，它不是RTL描述。 但是，其仿真结果，表3.2，提供了有用的信息。 怎样由上述行为级描述得到RTL级描述？ 从表3.2总结得出：sum =x⊕y⊕cin cout=(x⊕y)·cin+x·y (3-1)式从(3-1)式看出该5端口电路