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计算机组成原理 与 汇编语言 第 三 章 CPU原理 掌握： CPU基本组成模型（寄存器组成、数据通路结构），同步控制方式与常见时序信号，微命令（脉冲、电位），熟练掌握指令流程（能拟出给定指令的流程）；? ?理解： 进位链，ALU组成，补码加减，移位，浮点加减，无符号数一位乘、除，组合逻辑控制器（产生微命令方法、优缺点），微程序控制器（基本思想、优缺点）； 了解： 十进制运算，浮点乘、除法，微指令格式、编码方法、顺序控制方法。 §3-1 运算器 运算器 包含： ALU、用于运算的寄 存器； 控制器 包含：微操作信号发生器、时 序系统、用于运控制 的寄存器。 CPU的功能 数据加工（运算器） 对数据进行算术和逻辑运算处理； 指令控制（控制器） 指令的执行次序，严格按顺序； 操作控制（控制器） 由指令产生操作控制信号/微命令； 时间控制（控制器） 对各种操作实施时间上的控制/时序； 算术逻辑运算部件ALU ALU的主要作用完成二进制代码的定点算术运算和逻辑运算。ALU 的核心是加法器。 加法器 全加器 Ai Bi Ci ∑i, C i +1 可以用两个半加器构成的全加器; ∑I= Ai Bi Ci Ci+1= AiBi+(Ai Bi) Ci 并行加法器的进位 并行加法器：N位同时进行，由进位链实现进位信号Ci的传递。 设：A=An-1An-2…Ai..A1A0 B=Bn-1Bn-2…Bi..B1B0 则：Ci+1= AiBi+(Ai Bi) Ci 令： Gi= AiBi Pi= Ai Bi 于是： Ci+1= Gi+ Pi Ci 串行进位：使用进位线将n个全加器串接起来，进位延迟时间较长。节省器件，成本低。 并行进位：各级进位信号同时形成，增加硬件逻辑线路，有效地减少进位延迟时间。（同时进位） （见P61 图3-3）以4位加法为例 C1=G0+P0C0 C2=G1+P1C1 = G1 +P1G0 +P1P0C0 C3=G2+P2C2 =。。。。。 C4=G3+P3C3 =。。。。。 通过上式可以发现Ci可同时形成。 对于长字长的加法器通常采用分组进位结构： 组内并行、组间串行进位链 组内并行、组间并行进位链 ALU 举例 SN74181介绍 （见P62 图3-4）内部结构； 功能：4位ALU 完成16种算术逻辑运算； 4片SN74181和1片SN74182组成一个16位的组间并行进位ALU。 （见P63 图3-6 ） §3-2 运算方法 定点加减运算 原码加减 由操作码、操作数的符号决定最终的操作，结果的符号判断复杂； 繁琐，硬件复杂； 补码加减 [X + Y]补= [X]补+[Y]补 [X - Y]补= [X]补+[-Y]补 补码表示，符号参加运算，结果为补码表示； 例[X]补= [Y]补=[X + Y]补 [X - Y]补 + + 100000011 溢出的判断 运算结果为正，且大于所能表达的最大正数，称为正溢出； 运算结果为负，且小于所能表达的最小负数，称为负溢出； 溢出判断方法： P66 单符号位判断 最高有效位的进位判断 变形补码（双符号位） 00为正，11为负（运算时扩充） 结果01正溢出，10负溢出（判断） 例 P67 变形补码 请同学们练习 P111 第3题 （2） 第4题 （2） 移位 逻辑移位、循环移位和算术移位； 逻辑移位 无数值意义的二进制码，左移时低位补0，右移时高位补0； 循环移位 闭合移位环路 算术移位 带符号数的移位，左移一位相当于乘2，右移一位相当于除2； 原码 P68 补码右移 补码左移 浮点加减运算 规格化浮点数具有唯一的表示形式和最长的有效位； 运算与实现 （例 P70） X=Mx*2Ex ，Y=My * 2Ey 对阶操作：小阶向大阶看齐，尾数右移；求△E=Ex-Ey 尾数相加减：定点数的加减； 规格化和判溢 舍入：常用恒置1法 课本P111 第5题 解：E X补=11，01 M X补=00.110