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2011计算机组成原理试卷（A） 班级_________学号_________姓名_________成绩___________ 题号 一 二 三 四 五 六 总分 得分 一、选择题（每题2分，共20分） 1. 随着VLSI技术的发展，单位面积芯片上晶体管的数量增长态势遵从___________。 A. 冯?诺依曼定律 B. 摩尔定律 C. 哈佛定律 D. 图灵定律 2. 假定下列字符码中有奇偶校验位，但没有数据错误，采用偶校验的字符码是___________。 A B C D3. 下列技术中不是用于解决CPU和主存之间在速度上不匹配的问题的是___________。 A. 虚拟存储器 B. 双端口存储器 C. 多模块交叉存储器 D. cache存储器 4. 某4路组相连cache具有12行（编号0~11行），在cache为空的情况下，容量为120块的主存（编号B0~B119块）的第7数据块可能写入cache的行的编号是___________。 A. 3，7，11 B. 4，5，6，7 C. 9，10，11 D. 2，5，8，11 5. 定点9位字长的字，采用2的补码形式表示时，一个字所能表示的整数范围是___________。 A． -28 ~ + (28 -1) B. - (28 -1) ~ +(28 -1) C． - (28 +1) ~ + 28 D. -28 ~ +28 6. 某SRAM芯片，存储容量为64K×16位，该芯片的地址线和数据线数目为___________。 A. 64，16 B. 64，4 C. 16，16 D. 16，4 7. 下列关于微程序控制的描述，错误的是___________。 A. 执行一条指令也就是执行一段由多条微指令组成的微程序 B. 执行一条微指令就给出一组微操作控制信号，完成一组相应的微操作 C. CPU周期又叫机器周期，一个机器周期执行一条机器指令 D. 指令存放于主存储器，而微指令存放于控制存储器 8. 计数器定时查询属于集中式总线仲裁方式，其中计数器中的值代表的是___________。 A．占用总线的时钟周期数 B. 总线传送的数据块数目 C. 总线仲裁次数 D. 设备地址 9. 下列关于四种外围设备输入输出控制方式的描述中，错误的是：___________。 A．程序查询方式和程序中断方式都需要CPU的干预，DMA方式需要的CPU干预很少，而通道方式完全不需要CPU干预。 B. 中断发生的时机必须是一条指令执行完毕之后 C. DMA方式中，当DMA控制器从CPU接管了总线的控制权以后，数据交换无需CPU干预，直接在外围设备和内存之间进行 D. 通道方式硬件代价最高，但能比DMA方式更进一步减轻CPU对数据输入输出的控制，提高CPU的效率 10． 在单级中断系统中，CPU一旦响应中断，则立即关闭___________标志，以防本次中断服务结束前同级的其他中断源产生另一次中断进行干扰。 A. 中断允许 B. 中断请求 C. 中断屏蔽 D.中断保护 二、填空题（共35分） 1. （2分）若机器数为补码，某寄存器中的内容为AE(十六进制)，则该寄存器存储的整数真值是___________(用十进制表示)。 2. （3分）DRAM存储器的存储元是一个由_________和__________组成的记忆电路；DRAM在读出后必须_________。 3. （2分）指令的寻址方式有_________寻址方式和__________寻址方式两种。 4. （3分）常用的CACHE替换策略有:__________，_________，和____________。 5. （2分）在CPU中跟踪指令后继地址的寄存器是__________。 6. （3分）二地址指令根据操作数的物理位置可分为___________类型、___________类型和__________类型。 7. （3分）流水线中存在的三种数据冲突分别是___________，___________和____________。 8. （2分）三种集中式总线仲裁方式中，连线最少的是________，响应速度最快的是__________。 9.（2分）总线的定时方