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《数字逻辑》 课程设计说明书 课程名称： 数字电子技术基础 题 目： 数字时钟设计 专 业： 计算机科学与技术 学生姓名： 设计成绩： 2011年 1月 6 日 目 录 一、基本要求二、设计内容设计方案三、器件选择、、心得体会、 6个数码管显示时，分，秒 能是电子时钟复位 能启动或者停止电子钟的运行 在电子钟停止运行状态下，能修改时，分，秒的值 具有报时功能，整点时喇叭鸣叫 方案： 555定时器控制输入信号--------74160完成时间计数--------7448驱动SEVEN_SEG_COM显示管---------显示管准确显时 　此实验时间计数用74160，信号先通过74160，输出结果驱动BCD—七段显示译码器7448，最后将编码结果接入SEVEN_SEG_COM显示管，从而驱动对应的半导体数码管。由于时分秒各两位共六位数，因而需要六个74160，六个7448，六个SEVEN_SEG_COM显示管，各两个可编为一组。因为时分秒分别为二十四，六十，六十进制，所以通过置零的方法，将三组74160分别变为二十四，六十，六十进制。通过DSWPK_4置数，在保持的状态下直接输入目标时间即可让显示管瞬间显示校正后的时间。将避免在校准中一秒一分地往上加，节时，方便。之后调节EP再一次开始计时。 工作原理： 记时原理 通过给整个电子时钟引进连续脉冲，由于时和分的计算器无进位信号，所以只有秒计时器的计数结果不断增加，当计为59时，将其进位结果加到控制端EP，ET上，使分计时器开始计1，秒计时器回到零，随着秒计时器的脉冲的不断到来继续开始计时，一个周期结束继续给分计时器引进脉冲。当分计时器计到59时，它将也产生一个进位，于是将该进位信号进到时的计数器上，从而，使时计数器开始计为1，整个计时器不断计数，直到计数器显示23：59：59，当再加一个脉冲后，结果变为00：00：00，开始又一天的计时，如此周而复始，直到连续脉冲输入端断电。 电子时钟复位原理 　　所谓电子时钟的复位即为时，分，秒三组显示管同时为零即控制六个74160的ＲＤ’ 同时为零。 3 ．电子时钟的启动与停止 　　　根据计数器的功能分析可得，使控制端ＥＰ为零即可实现计数的停止，进入保持状态。 　　　４.修改时分秒 　　　在保持的状态下，使计数器的LD’等于零,再通过DSWPK_4进行置数。如果只想修给时，分，秒中的一项，只需将其它两组的脉冲信号接地，再按上述方法即可。 5.报时原理 当电子时钟的分和秒同时具有进位信号时，表明电子时钟显示为整点。将进位信号与蜂鸣器相连即可报时。 器件选择 六个74160同步十进制计数器 六个7448BCD---七段显示译码器 六个SEVEN_SEG_COM显示管 六个DSWPK_4计数器 一个555定时器 八个“与门”或“与非门” 电路原理图 五，心得与体会 在紧张的期末考试期间，花费了不少的时间，终于完成了电子时钟的设计实验，其过程不可谓不艰辛。 随着时间的不断流逝，老师与我们一起走过了大学第三个学期的数字电子设计课程。由于该课程理论层次相对较深，结合实际较紧密，所以在我学习该门课程中深感困难。我虽然没有选择放弃，但对这门课的学习只限于了解，没有更深层次的研究书中的具体内容。现在快考试了，才觉的书到用时方恨少。 在拿到这道设计题后，我的内心焦躁，却又无可，只能重新研究了一下书上的内容。后来经过认真分析，仔细构思，先分析设计过程，画草图，再画电子图，精心修改，最后终于按自己的想法设计出完整电路图，倍感欣慰。也许，设计的不太完美，但我已全力以赴。 总之，通过这次实验设计，感到了理论与实践结合的主要。在今后学习中，我会继续将所学知识运用到实践中，加深对理论知识的掌握。 参考文献 数字电子技术基础（第五版） 清华大学电子学教研组 编 阎石 主编 附录一：元器件清单 7448 74160 SEVEN_SEG_COM 附录二：元器件功能表 7448: 七段显示译码器 74160 十进制计数器