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课 程 实 验 报 告 课程名称： 微机接口 实验三 专业班级： 计算机1011班 学 号： U201014546 姓 名： 宋文轩 同组人员： 章宇威 指导教师： 熊自立 实验日期： 2013.05.12 计算机科学与技术学院 目录 1实验目的 3 2实验内容 3 3实验步骤 3 4实验源程序 4 5实验感想 7 一．实验目的 （1）通过实验掌握HDL的设计方法。充分利用课堂学习的知识，结合接口电路原理图设计、模块结构设计和状态分析，学习和掌握使用HDL设计接口电路的基本方法和调试方法。 （2）通过实验，学习和掌握ISE软件平台的使用规则和操作步骤（如建立工程、HDL编程与调试、综合、仿真等等），熟悉实验台（FPGA扩展模块）的使用，为顺利完成下学期的课程设计做好准备。 （3）通过在FPGA上实现1-2个简单的接口电路设计，验证自己的设计思路和方法，熟练掌握EDA设计流程，为今后的复杂电路设计奠定基础。 二．实验内容 实现下图38译码器 三．实验步骤 （1）创建一个工程 (a)设置工程名、存放地址 (b)选择芯片、选择综合工具、选择仿真工具、选择代码语言 (c)新建文件 (d)双击文件名，编写自己的代码 （2）综合 选择顶层芯片，双击Synthesize进行综合 （3）添加仿真文件 (a)新建仿真文件 (b)选择要仿真的模块 (c)编写仿真测试文件 (d)点这里Simulation，并选中test，展开即可看到要测试的模块 (e)选中新建的测试文件，这里有相应的操作，第一个是语法检查。先检查语法，然后再双击第二个进行仿真 （4）添加约束文件.ucf 新建约束文件并编写 （5）工程实现及产生流文件 选中顶层文件，综合操作，实现操作，生成流文件.bit （6）下载bit文件 (a)双击配置目标设备(Configure TargetDevice)子项目下的”ManageConfigurationProject…” (b)在弹出的窗口中双击“BoundaryScan” (c)之后窗口中间会出现”RightclicktoAddDeviceorInitializeJTAGchain”,按照只是右击，并选中”InitializeChain” (d)此时只要JTAG线连接正确，就会识别芯片，并出现如图所示的弹窗，询问是否要添加配置文件。我们选择”Yes”。 (e) 选中Yes后，出现弹窗。此时的选择是烧到PROM，也就断电可以保存的，这个稍后再说。这里选”Cancle”。之后会又弹一个同样的窗口。 (f)找到刚刚生成的bit文件的位置，选中，点open。 (g)弹出窗口，这是下载的属性设置，直接按照默认的即可，点击”OK” (h)右击右边的芯片，选择”Program”，此时对FPGA编程。 (i)出现编程成功。说明程序已经成功烧到FPGA中。 实验源程序 library IEEE; use IEEE.STD_LOGIC_1164.ALL; entity trans38 is port( A:in std_logic_vector(2 downto 0); a6:in std_logic; a7:in std_logic; a8:in std_logic; a9:in std_logic; aen:in std_logic; iow:in std_logic; ior:in std_logic; Y:out std_logic_vector(7 downto 0) ); end trans38; architecture dec_behave of trans38 is signal sel:std_logic_vector(3 downto 0); signal EN: std_logic; begin EN = not((a6 nand a6) and (a7) and (a8 nand a8) and a9 and (aen nand aen) and (iow nand ior)); sel=AEN; with sel select Y=when 0001, when 0011, when 0101, when 0111, when 1001, when 1011, 0