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第06章 时序逻辑电路 设计举例new.ppt
第六章 时序逻辑电路 设计 举例 例1：设计一个同步可变模计数器 不要求自启动 要求提供进位输出Y X为控制端， X 0时，为四进制加法计数器 X 1时，为五进制加法计数器 确定要使用多少个触发器： 1、设定状态，画出状态转换图。 根据题目要求， 状态转移表： 其状态转换图应为： X 0 X 1 2、选择触发器 选用D触发器 确定选用多少个D触发器： 最多5种状态，所以状态变量的个数n满足 2n≥5 ＝ n 3 共需要3个触发器 Q2Q1Q0 次态／输出卡诺图： 4、逻辑图 ５、静态检查并记录之 ６、动态检查 例2：设计一个同步可逆计数器 不要求自启动 要求提供输出Y。 X为控制端， X 0时，为三进制加法计数器，Y为进位输出 X 1时，为三进制减法计数器，Y为借位输出 设计要求： （1）设计并安装电路。 （2）静态检查并记录之。 （3）动态检查。 （4）完成实验报告。 1、设定状态，画出状态转换图。 根据题目要求， 状态转移表： 其状态转换图应为： X 0 X 1 2、选择触发器 选用JK触发器 确定选用多少个JK触发器： 3种状态，所以状态变量的个数n满足 2n≥3 ＝ n 2 共需要2个触发器 Q1Q0 次态／输出卡诺图： 3、求各触发器的驱动方程和进位输出方程 4、逻辑图 ５、静态检查并记录之 ６、动态检查 例3：5421码检测电路的设计 用D触发器设计一个5421BCD码检测电路，用于检测串行输入的5421码是否正确。 假设5421BCD码是由低位到高位串行输入的，如2的5421码是0010，则按0、1、0、0次序传送。如果在输入过程中代码发生错误——出现非法数码，则检测电路发生一脉冲信号。 5421码 2. 设定状态：画状态图 4. 状态化简（合并等效状态） 5. 状态编码 状态分配 6. 由状态转换表可得次态/输出卡诺图 由次态卡诺图求各触发器的状态方程 求输出方程 7. 求驱动方程 8. 画逻辑图 9. 检查是否能自启动 * 3个触发器 Q 0 Q Q 2 1 X/Y 0/0 000 011 010 001 0/0 0/0 0/1 000 011 010 001 1/0 1/0 1/0 100 1/0 1/1 CP X Q2Q1Q0 Q2n+1Q1n+1Q0n+1 Y 1 0 0 0 0 0 0 1 0 2 0 0 0 1 0 1 0 0 3 0 0 1 0 0 1 1 0 4 0 0 1 1 0 0 0 1 5 0 1 0 0 × × × × 6 0 1 0 1 × × × × 7 0 1 1 0 × × × × 8 0 1 1 1 × × × × 9 1 0 0 0 0 0 1 0 10 1 0 0 1 0 1 0 0 11 1 0 1 0 0 1 1 0 12 1 0 1 1 1 0 0 0 13 1 1 0 0 0 0 0 1 14 1 1 0 1 × × × × 15 1 1 1 0 × × × × 16 1 1 1 1 × × × × 011/0 100/0 010/0 001/0 × × × 000/1 × × × × 011/0 000/1 010/0 001/0 00 01 11 10 00 01 11 10 XQ2 Q1 Q0 Q2Q1Q0n+1/Y × 0 0 1 0 0 × × × 0 × × × × 0 0 0 0 00 01 11 10 00 01 11 10 XQ2 Q1 Q0 D2 D1 D0 Y 1 0 1 0 × × × 0 × × × × 1 0 1 0 00 01 11 10 00 01 11 10 XQ2 Q1 Q0 1 0 1 × × 0 × × × × 1 0 0 1 00 01 11 10 00 01 11 10 XQ2 Q1 Q0 0 0 0 0 × × × 1 × × × × 0 1 0 0 00 01 11 10 00 01 11 10 XQ2 Q1 Q0 D2 XQ1Q0 D1 Q1Q0 + Q1 Q0 D0 Q2Q0 3. 由次态、输出卡诺图求出次态和输出方程 Y Q2 + XQ1Q0 0 Q Q 1 X/Y 0/0 00 10 01 0/0 0/1 CP X Q1 Q0 Q1n+1 Q0n+1 Y 1 0 0 0 0 1 0 2 0 0 1 1 0 0 3 0 1 0 0 0 1 4 0
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