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《计算机组成原理B》 实 验 报 告 学 院： 电子与信息工程学院 专 业： 计算机 班级学号： 11200135114 学生姓名： 祁振东 指导老师： 黄研秋 实验日期：___________ 成绩评定：____________ 实验名称： 加减法器设计 实验内容： 采用图形化设计时先设计CAS单元，然后使用CAS单元设计四位加减法器。查看仿真结果时要考虑四种情况：加法、减法、正溢、负溢。还可以尝试AB均为正、AB均为负、A为正B为负、A为负B为正时候的加减法。 实验目的： 熟悉用Quartus II进行逻辑电路设计的方法。 通过4位加减法器的设计，掌握加减法器的基本原理。 VHDL程序或图形设计电路图： cas原理图 cas波形文件 四位加减法器原理图 四位加减法器波形文件 仿真结果与分析： Cas仿真结果1 Cas仿真结果2 四位加减法器仿真结果1 四位加减法器仿真结果1 心得体会： 熟悉了Quartus II进行逻