武汉创维特ARM教学systemARM体系结构-编程模型.pptVIP

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  • 2017-04-26 发布于四川
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武汉创维特ARM教学systemARM体系结构-编程模型.ppt

武汉创维特ARM教学systemARM体系结构-编程模型

嵌入式系统教案;提纲;ARM-Advanced RISC Machines ;ARM 公司的Chip less模式;ARM微处理器的应用领域 ;ARM微处理器的应用领域;ARM微处理器的特点—低功耗、低成本、高性能;ARM微处理器的特点—采用RISC体系结构;ARM微处理器的特点—大量使用寄存器;ARM微处理器的特点—高效的指令系统;ARM微处理器的特点—其他技术;ARM微处理器系列 ;ARM7微处理器系列 ;ARM7微处理器系列;ARM9微处理器系列 ;ARM9微处理器系列;ARM9E微处理器系列 ;ARM9E微处理器系列;ARM10E微处理器系列 ;ARM10E微处理器系列;SecurCore微处理器系列 ;SecurCore微处理器系列;StrongARM微处理器系列 ;Xscale处理器 ;ARM微处理器的工作状态 ;ARM与THUMB;状态切换方法 ;进入Thumb状态;切换到ARM状态;处理器模式;用户模式和特权模式;模式切换;ARM微处理器的存储器格式 ;ARM体系结构的存储器格式—大端格式 ;ARM体系结构的存储器格式—小端格式 ;指令长度及数据类型 ;非对???的存储访问操作 ;非对齐的指令预取操作 ;非对齐的数据访问操作 ;寄存器组织 ;ARM状态下的寄存器组织 ;ARM状态下的寄存器组织;未分组寄存器R0~R7;分组寄存器R8~R12;分组寄存器R13~R14;堆栈指针—R13;子程序连接寄存器—R14;程序计数器PC(R15);程序状态寄存器(CPSR/SPSR);Thumb状态下的寄存器组织 ;Thumb状态下的寄存器组织图;Thumb状态下的寄存器与ARM状态下的寄存器关系;Thumb状态下的寄存器与ARM状态下的寄存器关系图;访问THUMB状态下的高位寄存器(Hi-registers) ;程序状态寄存器 ;程序状态寄存器的每一位的安排 ;程序状态寄存器的条件码标志 ;影响标志位的指令;程序状态寄存器的控制位 ;处理器运行模式及可以访问的寄存器;异常(Exceptions) ;ARM体系结构所支持的异常类型 ;对异常的响应 ; R14_Exception_Mode = Return Link SPSR_Exception_Mode = CPSR CPSR[4:0] = Exception Mode Number CPSR[5] = 0 If Exception_Mode == Reset or FIQ then CPSR[6] = 1 CPSR[7] = 1 PC = Exception Vector Address;从异常返回;FIQ(Fast Interrupt Request);IRQ(Interrupt Request) ;ABORT(中止) ;Software Interruupt(软件中断) ;Undefined Instruction(未定义指令);异常向量表(Exception Vectors) ;异常优先级(Exception Priorities) ;应用程序中的异常处理

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