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2017-06-09 发布于广东
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排队论的多核处理器总线争用延时分析.pdf

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34 21 2008 11 Vol.34 No.21 Computer Engineering November 2008 ·· 2008 A TP39 ( 450002) cache Analysis of Delay-time of Bus Contention on Multi-core Processor Based on Queuing Theory ZHAO Zhao, JIANG Lie-hui, ZHAO Qiu-xia, LIU Hui, LIU Zhen-guo (College of Information Engineering, PLA Information Engineering University, Zhengzhou 450002) AbstractMulti-core is the trend in the field of processor. Communication in the multi-cores is realized either by the cache-share (cache memory), which is based on the bus system, or by the interlink technology-on-chip. In the architecture of multi-core processor which is based on bus-share, how to solve the bus contention between the multi-cores, and quantificationally analyze the delay time is the main gist of architecture optimization. By introducing queuing theory, this paper quantificationally analyzes delay of bus contention, gains the factors which infect the delay of bus contention, and provides quantitative gist for architecture optimization. Key wordsmulti-core processor; queuing theory; quantificational analysis; bus contention 1 / Intel, AMD, IBM / [1] 3 2 (SMP) 2.1 (DSM)CPU SMP SMP