DTMB标准中LDPC码的译码实现 Implementation of LDPC Code Decoder in DTMB.pdfVIP

DTMB标准中LDPC码的译码实现 Implementation of LDPC Code Decoder in DTMB.pdf

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卿熙照!煦艘蚴卿兰蚕0 文章编号:】002—8692(2007)10—0027—03 ·实用设计· DTMB标准中LDPC码的译码实现。 何庆涛,周正,葛建华 (西安电子科技太学综夸业务网理论厦关键技术国家重点实验室,陕西西安71007l、 【摘要】提出了一种准循环低密度筏姓码的部分并行译码结构,按照谖结构设计的泽码器可兼容多种码宰的准循环低密麓校鞋 码,同时适用于规则码和非规则码,固此只需设计1个译码器就可完成不同码率的准循环低密度校验码的译码。在川tera公司的 译码方案可节省大约45%的逻辑单元。 【关键词】准循环低密度奇偶校验码;母小和算法;部分并行结构;译码器 8l 【中图分类号】TN919 【文献标识码】A LDPCCodeDe00deriⅡDTMB hplementati仰0f HE Jun_h上a QI“g_‰,zH0c珏。峙GE (№如Mf&yL∞0,血£e芦刎Pd血舢e胁‘Ⅻo而s,x‘也t№却㈣饥艇抽”∞列,蕊f眦) deco山rarchitecturei8 lsnot ford“krentcode—ratesbutal㈤can fAbstnct】^Panially—P圳lel 011l,suitable proposed,whlch hu州lfor and is neededfor b‘)山Iegularimgula。quasi一。ycliclow—densily co山swi【hdi如弛ntcode—raIes.with dc(·0der矗Ir irI archikctu他,a d删e codesDTMB Qc—LDPc th。prop08ed kiIms“Qc—LDPc standardis inrPG^device—AltemStratixII—EP2s帅.FPGAresul俘showthatabout45%ofrouter坤一 implemented implememation be arcbheclllre. qujTemen担can savcd㈣I“P8red协prevj。us architectum;decoder 【Keywor出】Qc—LDPc:min—sumd90dIhm;pa坩auy—parallel 1 引言 2译码算法 低密度校验码(LDPC)“4是一种基于稀疏校验矩阵 Pmduct 的线性分组码,具有逼近香农限的译码性能,可采嗣并行 A190rithm)、最小和算法o(Min—sum A培)riI_IlⅡL) 实现的编泽码算法。准循环低密度校验(Qc—LDPC)码以及最小和改进算法H。其中,最小和改进算法是在最小 是T。PPc码的一种.其生成矩阵和校验矩阵都具有准循和算法的基础上增加一些

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