3.125gbs基于pspi型的时钟与数据恢复电路设计 design of a 3.125gbs ps pi-based clock and data recovery circuit.pdfVIP

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2017-08-25 发布于上海
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3.125gbs基于pspi型的时钟与数据恢复电路设计 design of a 3.125gbs ps pi-based clock and data recovery circuit.pdf

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3.125gbs基于pspi型的时钟与数据恢复电路设计 design of a 3.125gbs ps pi-based clock and data recovery circuit

巾国集成电路 China Integrated(：ircult 25G 3·1 b屉基于P剐P_蟹的时钟与数据恢复电路设计邱曼辚，张长春，李轩，李卫，郭宇锋，方玉明，陈德媛 (南京邮电大学电子科学与工程学院，江苏南京，2l0003) 特点，提出了一种在分接器后对超前、滞后信息进行统计比较得到一组低速信号来解决高速模拟电路和低速数字电路之间的接口问题。关键词：时钟数据恢复；数模混合电路；分接器；相位插值器 ofa3．125Gb／§PS／PI—basedClock Design andData Circuit RecoVery Min—wei，ZHANG QIU Chang—chun，LIxuan，UWei，GUOYu—feng，FANG Yu—ming，CHENDe—yuan ofElectronicScienceand ofPosts (School Engineering，NanjingUniversity and T色lecommunica—tion，Na两ing，210003，China) on0．18umCMOSfullrateofPS／PIc10ckaJlddata was AbStnct：Based process，a recovery(CDR)circuitdesigned． of Thecircuit consistsa detector， conⅡDller， maillly bang—bangphase digital de—multiplexer，phase tothechamcterist—icsofthe is amethodof the and CDR，there UP phaseinterpolator．According proposed comparing to DNinf0瑚ation世er order abatchof tosolvethe ofinted．acebetween demultiplexer，inget si印als problem h—igh circuit锄dlow circuit． speedaIlalog speeddi西tal words：C10ckaulddata detector recovery；Mixed Key aIlalog_digitalcimuit；Demultiplexer；Phase 1 引言如今显得尤为重要。为了提升芯片间的通信速度，