四位加法器及3线-8线译码器设计.docVIP

《EDA》课程设计 题 目 四位加法器及3线-8线译码器设计 学 号 姓 名 班 级 指导老师 2012 年 03月 01日 摘要 微电子技术，即大规模集成电路加工技术的进步是现代数字电子技术发展的基础。而现代电子技术的核心是EDA（Electronic Design Automation）技术。EDA技术就是依靠功能强大的电子计算机，在EDA工具平台上，对以硬件描述语言HDL（Hardware Description Language）为系统逻辑描述手段完成的设计文件，自动地完成逻辑编辑、化简、分割、综合、优化、仿真，直至下载到可编程逻辑器件CPLD/FPGA或专用集成电路ASIC芯片中，实现既定的电子电路设计功能。 EDA工具软件主要包括设计输入编辑器、仿真器、HDL综合器、适配器（或布局布线器）及下载器5个模块。而本次课设则分两部分，一是以Altera公司的Quartus7.2为工具软件，采用原理图输入法设计一个4位的加法器；二是通过上机实验掌握Verilog HDL文本输入语言和设计法，学习用Verilog HDL语言设计3线-8线译码器的方法。 目录 一 、概述 1.目的与要求………………………………….（04） 2.设计环境………………………………………（05） 二、4位加法器设计实现过程 1. 半加器的设计 ………………………………（07） 2. 1位全加器的设计…………………………（13） 3. 4位加法器的设计… ……………………...（16） 4、3线—8线译码器的设计……………………（18） 三、收获与心得体会 一 、概述 1目的与要求 1.1 设计目的： 通过对4位加法器的设计，以及3线—8线译码器的文本编辑，切实掌握Quartus7.2软件及Verilog HDL语言的使用方法。 1.2 要求 1.以Altera公司的Quartus7.2为工具软件，采用原理图输入法设计一个4位的加法器，该四位加法器由以下三个步骤完成： （1）采用原理图输入法设计半加器h_adder，生成元件符号，并仿真验证设计结果； （2）采用层次化原理图输入法设计1位全加器f_adder，生成元件符号，并仿真验证设计结果； （3）在1位全加器的基础上，设计4位加法器。 2、通过上机实验掌握Verilog HDL文本输入语言和设计法，学习用Verilog HDL语言设计3线-8线译码器的方法，掌握设计文本输入法的编辑、编译、仿真等操作方法。1.2设计环境 Quartus II 是Altera公司的综合开发，Quartus II集成环境支持 另外，Quartus II可以在XP、Linux以及Unix上使用，除了可以使用Tcl脚本完成设计流程外，提供了完善的用户图形界面设计方式。具有运行速度快，界面统一，功能集中，易学易用等特点支持Altera的IP核，包含了LPM/MegaFunction宏功能模块库，使用户可以充分利用成熟的模块，简化了设计的复杂性、加快了设计速度。对第三方EDA工具的良好支持也使用户可以在设计流程的各个阶段使用熟悉的第三方EDA工具此外，Quartus II 通过和DSP Builder工具与Matlab/Simulink相结合，可以方便地实现各种DSP应用系统；支持Altera的片上可编程系统（SOPC）开发，集系统级设计、嵌入式软件开发、可编程逻辑设计于一体，是一种综合性的开发平台。 　　Maxplus II 作为Altera的上一代PLD设计软件，由于其出色的易用性而得到了广泛的应用。目前Altera已经停止了对Maxplus II 的更新支持，Quartus II 与之相比不仅仅是支持器件类型的丰富和图形界面的改变。Altera在Quartus II 中包含了许多诸如SignalTap II、Chip Editor和RTL Viewer的设计辅助工具，集成了SOPC和HardCopy设计流程，并且继承了Maxplus II 友好的图形界面及简便的使用方法。 Quartus II 作为一种可编程逻辑的设计环境, 由于其强大的设计能力和直观易用的接口，越来越受到数字系统设计者的欢迎。可编程逻辑软件属于第四代PLD开发平台。该平台支持一个工作组环境下的设计要求，其中包括支持基于Internet的协作设计。Quartus平台与Cadence、ExemplarLogic、 MentorGraphics、Synopsys和Synplicity等EDA供应商的开发工具相兼容。改进了软件的LogicLock模块设计功能，增添 了FastFit编译选项，推进了网络编辑性能，而且提升了调试能力。支持MAX7000/MAX