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简易DDS波形发生器设计
实验二 简易DDS波形发生器设计
084775116 马丽丽
084775117 潘奕颖
实验目的：进一步熟悉绘制ASM图分析实验的方法；
进一步掌握将VHDL程序符号化的使用方法；
熟悉ROM表的制作与符号化；
了解DDS波形发生器的基本原理。
实验内容：利用FPGA和DAC，设计一个简易的DDS波形发
生器并发出正弦波。
设计要求：1.分辨率优于1Hz；
2.ROM表长度8位，位宽10位；
3.输出频率优于100kHz（每个周期数据点大于50）；
4.显示信号频率/频率控制字（可切换）；
5.直接输入频率控制字或输出频率。
四、 实验仪器：计算机1台；
QUARTUS II软件一套；
试验箱1台。
方法步骤：
1. 绘制ASM图；
阅读实验要求，分析实验过程，然后绘制ASM图如下页：
Y
2. 建立一个工程；
打开QUARTUS II软件，Files → New Project Wizard → 选择储存路径→ next → next → 选择芯片Cyclone II EP2C5T144C8 → next → finish。
3. 编写累加器的VHDL文件,并将其转换成图形文件；
①Files → New → VHDL File → 开始编写程序；
②经过编写后，进行编译(Tools → Compiler Tool →Strart),改错，再编译，改错直至编译成功，保 存文件名为“dds1.vhd”；
程序如下:
library ieee;
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity dds1 is
port(
m:in std_logic_vector(19 downto 0);
cp,r:in std_logic;
q:out std_logic_vector(7 downto 0)
);
end dds1;
architecture z of dds1 is
signal t:std_logic_vector(22 downto 0);
signal n:std_logic_vector(22 downto 0);
begin
process(cp)
begin
n=000m;
if cpevent and cp=1 then
if r=1 then
t=00000000000000000000000;
elsif t+n8388607 then
t=00000000000000000000000;
else
t=t+n;
end if;
end if;
q=t(22 downto 15);
end process;
end z;
③编译通过以后，File → Create/Update → Create Symbol Files For Current File。
4. 制作ROM表；
①Files → New → Memory Initialization File；
②在Excel表中输入变量及公式算出ROM表中内容然后取整，复制到ROM表中保存文件名为“dds2.mif”。
ROM内容如下：
Addr +0 +1 +2 +3 +4 +5 +6 +7 0 512 524 537 549 562 574 587 599 8 611 624 636 648 660 672 684 696 16 707 719 730 741 753 764 774 785 24 796 806 816 826 836 846 855 864 32 873 882 890 899 907 915 922 930 40 937 944 950 957 963 968 974 979 48 984 989 993 997 1001 1004 1008 1011 56 1013 1015 1017 1019 1021 1022
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