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第五部分第九章 单片机系统扩展 通过地址总线、数据总线和控制总线实现ROM、RAM的扩展（ MOVX指令的运用）。 并行I/O接口、串行总线接口扩展。 9.1 存储器的扩展 9.2 并行I/O接口的扩展 9.3 串行总线接口扩展 9.1 存储器的扩展 思考题： MCS-51单片机的三总线是如何分配的？ （一）程序存储器ROM的扩展 1，单片机的P0、P2口作为外电路的数据、地址总线：P0口做为低8位地址和数据复用总线； 　　　 P2口做为高8位地址总线。 2，单片机的/Psen 作为数据选通信号与外ROM的数据输出三态控制/OE端连接（参照访问外存储器的时序）； 3，使用一个8位的数据锁存器来锁定低八位地址信号，使用单片机的ALE信号作锁存器的锁存控制 具有三态功能的8D锁存器 /L：三态控制。 低电平：允许数据输出，三态门通； 高电平：三态门关闭，输出高阻。 G：数据锁存控制。 高电平时，输出随输入变化； 低电平时，Q端将被所存（低电平锁存）。 ① MCS-51与1片32K ROM的连接（地址线全译码） 外部ROM的状态与地址线A15的关系表 访问外部程序存储器ROM的时序: 片外存储器访问时序说明 P0、P2口作地址和数据总线。其中P0口作为地址和数据复用总线，前半部（A段）作地址总线，后半部（B段)作为数据总线。 外部程序存储器ROM的操作步骤如下： 1，必须为ROM其提供完整的（15位）地址信息； 2，ROM芯片的/CE 端=0，选中该芯片； 3，在满足上述条件的基础上，当ROM的/OE=0时（B时间段），存储器输出数据的三态门打开，并将与输入地址相对应的存储单元中的指令（数据）向外输出，单片机通过P0口将指令送至CPU 内部。 74LS373锁存器:将A时间段P0口输出的低位地址进行保存，使ROM在B时间段仍然可以得到完整的地址信号。 ② MCS-51与2片32K ROM的连接（地址线全译码） 如何使用两片32K的ROM芯片扩展为64K的存储阵列。 由两片32K的ROM构成64K存储阵列与A15的关系表 ③ MCS-51与多个 ROM的连接（地址线全译码） 若需要对2片以上的芯片扩展，可以通过译码电路实现。 74LS138 3-8线译码器（P168） A、B、C：选择输入。作为与输出对应的二进制编码输入； G1、/G2A、G2B：使能输入，作为片选控制输入； y7～y0：译码器输出，低电平有效。 采用LS138译码器实现ROM扩展示意表 采用不完全译码的简易ROM扩展电路（一） 部分译码造成的地址重叠（一） 采用不完全译码的简易ROM扩展电路（二） 部分译码造成的地址重叠（二） 部分译码扩展电路的特点 以上面电路（一）为例： 由于P2.5～P2.7没有与存储器的地址信号连接，所以3位地址信号对于存储器来说是不起任何作用的。 重叠地址的数量与空余地址线的条数有关： 重叠地址数=2n ；其中n为空余地址线数。 对于使用ROM空间小于64K时，可以考虑使用部分译码的方式，以简化电路的设计、降低电路成本。一般情况，编程时稍加注意，地址重迭不会带来使用上的问题。 （二）数据存储器RAM的扩展 同程序存储器扩展，使用P0、P2口作为地址、数据总线。 1，当使用 MOVX @Ri ,A指令时，系统仅使用P0口输出地址信号（P2口不用）； 2，当使用 MOVX @DPTR,A 指令时，P0口输出DPTR提供 的低八位地址信号，P2口输出DPTR提供的高八位地址 信号。 3，不论哪种情况，P0口都是地址/数据复用总线，因此 仍要使用74LS373来锁存P0口的地位地址信号。 与ROM扩展不同：使用访问外部RAM指令MOVX 时，在时序中将产生/RD或/WR信号，因此将此信号与外RAM的读（/RD) 、写（/WR）控制端相连接就实现系统对外RAM的读写控制。 读外部数据存储器RAM的指令时序 设外部RAM2000H单元中有一个数x,且DPTR中已存有该数地址2000H.则CPU 执行外部ROM中的指令: MOVX A , @DPTR ；将外RAM的x送A ①MCS-51与32K RAM的连接 小 结 1，外部存储器是使用P0、P2口作为地址、数据总线； 2，因为P0口为数据、地址复用总线，必须用74LS373