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VLSICAD 组发展近况
VLSI/CAD 組發展近況
雷曉方
2010
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設計、製造與測試
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– 聯發科、聯詠、立錡、奇景
– 撰寫硬體描述語言(Verilog)
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封裝及測試公司
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Good IC
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Bad IC
4
EE VLSI GROUP
VLSI Design LAB National Cheng Kung University
System/IC Development Flow
Applications Specifications System Design Component Design
Hardware: always @(posedge clk)
傳輸距離:100 m CPU, begin
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功能:影像傳輸、 out=in1;
語音傳輸 else
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