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第十五讲 Setting BIT / TI 第十五讲 芯片设置 内容简介 芯片的状态设置 存储器映射(memory map) ‘C6000的系统时钟 自加载（Boot） 定时器（Timer） 芯片的设置内容 设置系统时钟 CPU主频 PLL倍频因子 选择存储器映射方式 MAP0 MAP1 选择地址空间0处的存储器类型 片内RAM 片外存储器（ROM/SBSRAM/SDRAM/速度/字长） 设定芯片的引导方式 Endian 系统时钟—C6201 系统时钟—C6202 系统时钟—C6203 系统时钟—C6701 系统时钟—C6211/C6711 存储器映射 存储器映射 引导方式 没有BOOT过程 复位结束后直接开始执行地址0处的指令 ROM引导 外部CE1空间配置有ROM DMA/EDMA将ROM中程序拷入地址0处 传输完成后，CPU退出复位状态，执行地址0处的指令 HPI引导 核心CPU保持在复位状态，其余部分保持激活状态 由外部主机初始化CPU的存储空间 主机置DSPINT为1，唤醒CPU，结束引导过程 设置管脚 每次复位后检查芯片设置 CLKMODE[ ] BOOTMODE[4:0] C6202/C6203利用扩展总线XD[31:9]和XD[7:5] 定时器—概述 两个32-bit计数器 两种信号模式 时钟源可以是内部/外部 可以作为通用I/O口 控制寄存器 Timer control register Timer period register Timer counter register 定时器—框图 定时器—信号模式 定时器—通用I/O * 两种倍频选项，CPU最高频率233MHz SSCLK/SDCLK分开 4个输出时钟信号 需要PLLFREQ设置 两种倍频选项，CPU最高频率250MHz 2个输出时钟信号 没有专用的SSCLK/SDCLK时钟 扩展总线的时钟另外由外部供给 8种倍频选项，CPU最高频率300MHz 2个输出时钟信号 没有专用的SSCLK/SDCLK时钟 扩展总线的时钟另外由外部供给 两种倍频选项，CPU最高频率167MHz SSCLK/SDCLK分开 4个输出时钟信号 需要PLLFREQ设置 两种倍频选项，CPU最高频率167/150MHz 2个输出时钟信号 没有专用的SSCLK/SDCLK时钟 C6201/C6202/C6701 C6211/C6711 寄存器控制各个开关点 脉冲模式 脉冲宽度可以是1/2 时钟模式 对称波形 可以控制TSTAT值反相输出