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2018-06-22 发布于江苏
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JK触发器地应用设计.ppt

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JK触发器地应用设计

实验四JK触发器的应用设计 2、设计二分频、四分频电路：将第二个JK触发器的J、K端连接在一起接到第一个触发器的Q，输入1KHZ方波。画出实验电路图，测绘CP、Q1、Q2的波形，标出幅值和周期，理解二分频、四分频的概念。思考题如何将JK触发器转换成T触发器和D 触发器？实验五 N进制计数器的设计 * 一、实验目的熟悉并验证触发器的逻辑功能及相互转换的方法掌握集成JK触发器逻辑功能的测试方法学习用JK触发器构成简单时序逻辑电路的方法进一步熟悉用双踪示波器测量多个波形的方法二、实验元器件：双JK触发器：4027 1片(引脚图见实验教材P104) 输入输出（次态）现态 SD RD CP J K Qn Qn+1 Qn+1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 0 0 1 1 1 1 1 × × × × × × × × × × × × × × × × 1 CC4027功能表三、实验内容： 1、按JK触发器逻辑功能表验证JK 触发器的逻辑功能 JK触发器特性方程和功能表 JK触发器功能表特性方程类型 Qn+1=JQn+KQn J K Qn+1 1 1 0 0 0 1 1 0 1 Qn 0 Qn CP Q1 Q1 Q2 波形电路图 JK1 JK2 +5V(“1”) CP 0 0 0 0 J1 Q1 J2 K1 K2 Q1 Q2 Q2 RD SD RD SD Q1 Q2 四、注意事项： 1、VDD接电源正极，VSS接电源负极（通常接地），电源绝对不允许接反。实验一般要求为+5V电源。 2、所有输入端一律不准悬空。 3、不使用的输入端应按逻辑要求直接接VDD或VSS，在工作速度不高的电路中，允许输入端并联使用。 4、输出端不允许直接与VDD或VSS连接，不允许两个器件输出端连接使用。 5、示波器观察多个波形时，注意选用频率最低的电压作触发电压。 *