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- 2018-08-01 发布于贵州
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课程设计（论文）实验报告基于VHDL的数字钟设计
本科实验报告
题目：数字钟
课程名称：
学院（系）：
专 业：
班 级：
学生姓名：
学 号：
完成日期：
成 绩：
2011 年 12 月 12 日
题目：数字钟
1 设计要求
系统功能：
1.计时，数码管显示的‘时’、‘分’、‘秒’的十进制数字显示（小时从00～23）计时器
2.星期，lcd1602显示星期：MON/TUE/WEN/THU/FRI/SAT/SUN
3.校准，具有手动校星期、校时、校分、校秒的功能。
4.秒表，显示1%秒、60秒，60分，能手动开始和停止
5.闹钟，能在设定的时间发出闹铃声。
6.整点报时，即从59分55秒起，每隔1秒钟发出一次低音“嘟”的信号，连续2次，最后一次为高音“嘀”的信号，此信号结束即达到整点，发音的同时伴有led闪烁。
7.倒计时，能在设定的时间开始倒计时，至0时0分0秒停止
2 设计分析及系统方案设计
一．设计分析：
依据功能要求，程序分为
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