(上)(Verilog+Quartus Ⅱ+Cyclone版)主讲杨全胜东南大 精选篇.pptVIP

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  • 2018-09-23 发布于湖北
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(上)(Verilog+Quartus Ⅱ+Cyclone版)主讲杨全胜东南大 精选篇.ppt

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MiniSys指令格式详解 100 100 100 100 * P.* * MiniSys指令格式详解 * P.* * MiniSys指令格式详解 * P.* * MiniSys指令格式详解 * P.* * 第3章 MiniSys的设计 MiniSys CPU设计架构 MiniSys CPU中各个单元 指令执行的分析 设计流水线处理器的考虑 设计多核处理器的考虑 * P.* * MiniSys CPU设计架构(1) 指令执行的步骤 ifetch idecode Control Execute Write Dmemory * P.* * PC Clock 程序ROM 读地址 指令 [31-0] + 4 控制单元 op 寄存器 0 1 func rs rt rd readR1 readR2 writeR writeD Clock readD1 readD2 Regdst WE Alusrc 符号扩展 immediate 0 1 A B Zero Alu result ALU Address Write Data Mem data 数据RAM 1 0 WE 1 0 jal Regwrite MemtoReg MemWrite Sftmd/sftm/I_format + 左移2位 nBranch Branch 0 1 0 1

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