多路高速时钟生成系统的同步输出设计.PDFVIP

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2019-04-08 发布于天津
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多路高速时钟生成系统的同步输出设计.PDF

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多路高速时钟生成系统的同步输出设计.PDF

V01．32 第32卷第6期中国测试技术 No．6 CHINA 2006年11月 MEASUREMENTTECHNOLOGY Nov．2006 多路高速时钟生成系统的同步输出设计王猛，崔文涛，田书林 (电子科技大学自动化学院，四川成都，610054) 侧重于非对称布局条件下的多通道时钟同步输出，介绍了CDCF5801的工作原理，时钟系统的同步原理，分析了器件功率耗散对时钟信号完整性的影响，最后给出该系统的时钟输出仿真图和具体实验结果，系统时钟信号质量、同步效果良好。关键词：同步时钟；CDCF5801；信号完整性；阻抗匹配中图分类号：TM935．1 文献标识码：A 文章编号：1672-4984(2006}06-0094-03 of for dock distribution Designsynchronizationhighspeed system WANG Shu-lin Wen-tao，TIAN Meng，CUI ofAutomation of (School ElectronicScienceand Engineering，University Technology，Chengdu610054，China) Abstract：This a of basedmulti-channel CDCF5801 cleekdistribution paperpresenteddesign synchronization network．Thestressofthe was onthe multichannel clock for paper phced synchronizing hishs雕!ed signals introducestheconstructionofCDCF5801and a dissymmetricallayout．Thispaper principle analyzedsignalintegrity of thataffectthe clock inthe resultsshowthattheclock problempowerdissipation quality system．Theexperiment and are for bothsuitable signalqualitysynchronizationperformance systemrequirements． Keywords：Synchronization；CDCF5801；Signalintegrity；Dis