组合逻辑门电路与译码器华农.pdfVIP

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2021-01-11 发布于天津
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组合逻辑门电路与译码器华农.pdf

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一、实验目的 1. 加深理解组合电路的分析方法。 2. 练习利用与非门接成其它几种逻辑门和及半加器。 3. 掌握一般组合逻辑电路的分析和设计方法。 4. 熟悉集成译码器的逻辑功能及应用。 5. 了解译码器的拓展。 6. 掌握译码器的主要应用。二、实验仪器与元器件 1. 数字电路实验箱一只。 2. 二输入四“与非门”集成块 (74LS00)X2 三输入三“与非门”集成块（ 74LS10）X2 3. 译码器 74LS138 两块，管脚图如图（ 4-1 ）所示。 4. 四输入与非门 74LS20 一块。 74LS00 与 74LS10 引脚图 74LS138 引脚图三、实验注意事项 1. 实验时，人体不可接触带电线路。连接电路前要检查电源总开关是否为“关” 。 2. 实验中如果需要改接线路，必须按下“关”按钮以及切断电源，保证实验操作安全。四、实验项目及原理 1. 检查“ 0 ”电平对与非门的封锁控制作用；原理：输入先进行与运算，输入引脚接低电平时分别有 0 ，01 ，10，00 ，与运算后都是 0，再非运算后输出为 1. 即只要与非门有 1 个接低电平，其它引脚有方波输入，输出为 1. 相当于被封锁。逻辑式： Y=(A ·B)=A+B ①逻辑图： ②真值表： 2. 半加器电路 ①逻辑式： S=A B+ AB，C=AB. ②逻辑图： A B S C 0 0 0 0 0 1 1 0 1 0 1 0 ③真值表： 1 1 0 1 3. 试设计供 A、B、C 三人表决用的逻辑电路。约定：赞成为“ 1”不赞成为“ 0”，多数赞成则通过，输出 F=1，指示灯亮，反之 F=0，灯不亮。写出与非门表示的逻辑式，并验证之。 ①逻辑式： ②逻辑图： A B C F 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 0 1 0 1 1 1 1 0 1 ③真值表： 1 1 1 1 4. 信号选通电路。 1 2 ①逻辑式： Z=AM+ AM ②逻辑图： ③真值表： 5. 按 3-5 接线，用与非门设计一个组合电路使电路的输出实现输入的平方，并接线验证设计结果，填入表 3-4 中。 ①逻辑式： ②逻辑图 : ③真值表： A0 A1 Q1 Q2 Q3 Q4 0 0 0 0 0 0 0 1 0 0 0 1 1 0 0 1 0 0 1 1 1 0 0 1 6.74LS138 ①真值表： 7. 全减器 ①逻辑式：；