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计算机组成原理第3 章习题参考答案解析 关建字摘要：存储器，地址，主存，芯片，存条，字长，行号，刷新，译码器，映射 竭诚为您提供优质文档，本文已整理修正，内容完整 10 共 页，请先行预览，如有帮助感谢下载支持 *****高品质PDF ，可编辑可打印可自行转换***** .. .. 1、设有一个具有20 位地址和 32 位字长的存储器，问 (1) 该存储器能存储多少字节的信息 (2) 如果存储器由 512K×8 位 SRAM 芯片组成，需要多少片 (3) 需要多少位地址作芯片选择 解： 32 (1) 该存储器能存储：220 ´ = 4M字节 8 220 ´32 220 ´32 (2) 需要 = = 8片 512K ´8 219 ´8 (3) 用 512K 8 位的芯片构成字长为 32 位的存储器，则需要每 4 片为一组进行 字长的位数扩展，然后再由 2 组进行存储器容量的扩展。所以只需一位最高位地 址进行芯片选择。 2、已知某 64 位机主存采用半导体存储器，其地址码为 26 位，若使用 4M×8 位 的DRAM 芯片组成该机所允许的最大主存空间，并选用存条结构形式，问； (1) 若每个存条为 16M×64 位，共需几个存条? (2) 每个存条共有多少 DRAM 芯片? (3) 主存共需多少 DRAM 芯片? CPU 如何选择各存条? 解： 226 ´64 (1) 共需 = 4条存条 16M ´64 16M ´64 (2) 每个存条共有 = 32 个芯片 4M ´8 226 ´64 64M ´64 (3) 主存共需多少 = = 128 个 RAM 芯片，共有 4 个存条，故 CPU 4M ´8 4M ´8 选择存条用最高两位地址 A 和 A 通过 2：4 译码器实现；其余的24 根地址线用 24 25 于存条部单元的选择。 3、用16K×8位的DRAM芯片构成64K×32位存储器，要求： (1) 画出该存储器的组成逻辑框图。 (2) 设存储器读/写周期为 0.5 μS，CPU 在 1 μS 至少要访问一次。试问采用哪种 刷新方式比较合理?两次刷新的最大时间间隔是多少 ?对全部存储单元刷新一遍 所需的实际刷新时间是多少? 解： 64K ´32 (1) 用16K×8位的DRAM芯片构成64K×32位存储器，需要用 = 4 ´4 = 16 16K ´8 个芯片，其中每4片为一组构成16K×32位——进行字长位数扩展(一组的4个芯片 只有数据信号线不互连——分别接D D 、D D 、D D 和D D ，其余同名 0 7 8 15 16 23 24 31 . . . . .. .. 引脚互连)，需要低14位地址(A A )作为模块各个芯片的部单元地址——分成 0 13 行、列地址两次由A