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触发器的逻辑功能测试及异步二进制计数器 电气与自动化工程学院 电工电子实验中心 一、实验目的 掌握JK和D触发器的逻辑功能 掌握集成触发器的使用方法 熟悉触发器之间相互转换的方法 学习用集成触发器构成计数器的方法 二、实验内容 1．测试双JK触发器74LS76的逻辑功能。 2．测试双D触发器74LS74的逻辑功能。 3．JK触发器转换成T触发器，D触发器转 换成T′触发器。 4．异步二进制计数器。 三、实验内容及步骤 1、从74LS76中任选一个JK触发器，将其J、K端接逻辑开关输入插口，CP端接单次脉冲源，Q端接至逻辑电平显示输入插口。在图16-3上画出连接线路，然后照图接线。按表16-1测试其逻辑功能并记录结果。 2、74LS74中任选一个D触发器，按表16-2测试其逻辑功能并记录结果。方法同上 3、图16-4是由JK触发器构成T触发器及由D触发器构成的T′触发器的电路图。 (1)用74LS76按图16-4(a)接线。按表16-3测试其逻辑功能。 3、图16-4是由JK触发器构成T触发器及由D触发器构成的T′触发器的电路图。 (2)用74LS74按图16-4(b)接线。按表16-4测试其逻辑功能。 4．T′触发器是构成异步二进制计数器的基本单元。在图16-5中选择一个电路实现，观察电路的输出Q1Q0，记入表16-5，说明该电路的逻辑功能。 四、简答题 在图16-6中经过一个CP脉冲后，JK触发器为何种状态？ 触发器在实际使用时，如果把输入端悬空当作高电平是否合适？ * 电工电子实验中心 电气与自动化工程学院 * 电气与自动化工程学院 图16-1 74LS76双JK触发器引脚排列与逻辑符号 74LS76是带有置位和清零的双JK触发器，每个触发器都有一对直接清“0”、置“1”输入端，有Q互补输出。为下降沿触发型JK触发器。 图16-2 74LS74 D触发器引脚排列与逻辑符号 D触发器： 74LS74是带置位和清零的双D型触发器，每个触发器都有一对直接清“0”、置“1”输入端，并且有Q互补输出。数据输入端D的信息只在时钟脉冲的上升沿被传递到Q端输出。 1、J触发器功能测试 图16-3 JK触发器逻辑功能测试线路 表16-1 JK触发器 表16-2 D触发器 图16-4 (a）T触发器 表16-3 T触发器 图16-4 (b）T′触发器 表16-4 T′触发器 图16-5 表16-5 图16-6 * *
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