硬件描述语言及其程序设计方法.pptVIP

第讲硬件描述语言及其程序设计方法 第1页，共34页。 目 录 SOC设计概述 可编程逻辑器件 硬件描述语言及其程序设计方法 SOC的设计－基本工具和方法 SOC设计实例 第2页，共34页。 Verilog HDL 简介 Verilog HDL是一种硬件描述语言，用于从算法级、门级到开关级的多种抽象设计层次的数字系统建模。 Verilog HDL语言具有下述描述能力： 设计的行为特性 设计的数据流特性 设计的结构组成 包含响应监控和设计验证方面的时延和波形产生机制。 Verilog HDL语言不仅定义了语法，而且对每个语法结构都定义了清晰的模拟、仿真语义。因此，用这种语言编写的模型能够使用Verilog仿真器进行验证。 第3页，共34页。 Verilog HDL 简介 Verilog HDL硬件描述语言的主要能力： 基本逻辑门，例如and、or和nand等都内置在语言中。 用户定义原语（UDP）创建的灵活性。用户定义的原语既可以是组合逻辑原语，也可以是时序逻辑原语。 开关级基本结构模型，例如pmos和nmos等也被内置在语言中。 提供显式语言结构指定设计中端口到端口的时延及路径时延和设计的时序检查。 可采用三种不同方式或混合方式对设计建模。这些方式包括：行为描述方式－－使用过程化结构建模；数据流方式－－使用连续赋值语句方式建模；结构化方式－－使用门和