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EDA实验报告 姓 名 刘欢庭 所在学院 电子信息工程学院 专业班级 2013级通信工程 学 号 013123157 实验一 译码器的设计（2—4译码器） 一、实验目的 1.能了解组合逻辑中译码器电路的设计原理 2.能利用CPLD数字发展实验系统设计一个二对四译码器 3.能自行验证所设计电路的正确性 二、实验内容及要求 设计一个2—4译码器，并下载到实验板进行验证 三、实验器材 1.软件：Altera公司的Quartus Ⅱ软件 2.芯片：Altera公司的EP2C8T144C8 3.开发平台：KH—31001智能型可编程数字开发系统 四、实验电路图 五、功能仿真 六、引脚分配 输入、输出端口 芯片引脚 S1 P28 S0 P25 M3 P53 M2 P55 M1 P57 M0 P58 实验二 四位二进制同步计数器 一、实验目的 1.能了解四位二进制同步计数器的设计原理及其特性 2.能设计一个四位二进制同步计数器 3.能自行以CPLD数位发展实验系统验证所设计的正确性 二、实验内容及要求 设计一个四位二进制同步计数器电路，并下载到实验板进行验证 三、实验器材 1.软件：Altera公司的Quartus Ⅱ软件 2.芯片：Altera公司的EP2C8T144C8