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全加器实验报告
深圳大学实验报告
实验课程名称：数字电路与逻辑设计
实验项目名称：全加器
学院：信息工程学院
专业：电子信息工程
报告人：学号：班级：
指导教师：张志朋
实验时间：
实验报告提交时间：
实验设计
数据记录与处理
任务一：
CI0
A1
B1
A2
B2
A3
B3
A4
B4
F1
F2
F3
F4
CO4
任务二：
输入
输出
输入
输出
余3码
理论图形
实验图形
余3码
理论图形
实验图形
0011
1000
0100
1001
0101
1010
0110
1011
0111
1100
六、实验结论
指导教师批阅意见：
成绩评定：
指导教师签字：
年月日
备注：
注：1、报告内的项目或内容设置，可根据实际情况加以调整和补充。
2、教师批改学生实验报告时间应在学生提交实验报告时间后10日内
数据记录与处理
任务一：
CI0
A1
B1
A2
B2
A3
B3
A4
B4
F1
F2
F3
F4
CO4
任务二：
输入
输出
输入
输出
余3码
理论图形
实验图形
余3码
理论图形
实验图形
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