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(多项选择题)1:EDA技术发展阶段描述正确是()。
A:CAD阶段
B:CAE阶段
C:EDA阶段
D:以上都不对
正确答案:
(多项选择题)2:TOP-down设计通常分为哪几个层次()。
A:系统级
B:功效级
C:门级
D:开关级
正确答案:
(多项选择题)3:ASIC电路特点描述正确是()。
A:周期长
B:投入高
C:功耗低
D:省面积
正确答案:
(多项选择题)4:基于FPGA/CPLD器件数字系统设计流程包含哪些阶段()。
A:设计输入
B:综合
C:布局布线
D:仿真和编程
正确答案:
(多项选择题)5:下面哪些是专业提供PLD器件厂商()。
A:Xilinx
B:Altera
C:Lattice
D:Micsoftware
正确答案:
(多项选择题)6:惯用集成FPGA/CPLD开发工具备哪些()。
A:MAX+plusII
B:QuartusII
C:ISE
D:ispLEVER
正确答案:
(多项选择题)7:综合有哪几个形式()。
A:RTL
B:逻辑综合
C:将逻辑门表示转换到版图表示
正确答案:
(多项选择题)8:布局布线完成后会产生哪些文件()。
A:芯片资源耗用汇报
B:EDIF
C:延时网表
D:器件编程文件
正确答案:
(多项选择题)9:基于EDA技术设计中,通常有两种设计思绪()。
A:自顶向下
B:自底向上
C:自前向后
D:自后向前
正确答案:
(多项选择题)10:状态机惯用编码方式有()。
A:次序编码
B:格雷编码
C:约翰逊编码
D:一位热码
正确答案:
(判断题)1:布局布线为将综合生成电路逻辑网表映射到详细目标器件中实现,并产生最终可下载文件过程。
A:错误
B:正确
正确答案:
(判断题)2:SOC是SystemOnChip,芯片系统缩写。
A:错误
B:正确
正确答案:
(判断题)3:HDL是一个用文本形式来描述和设计电路语言。
A:错误
B:正确
正确答案:
(判断题)4:在EDA设计中通常采取硬件描述语言(HDL)进行电路与系统描述。
A:错误
B:正确
正确答案:
(判断题)5:有限状态机复位分为两种:同时复位和异步复位。
A:错误
B:正确
正确答案:
(判断题)6:PROM(ProgrammableRead-OnlyMemory),可编程只读存放器缩写。
A:错误
B:正确
正确答案:
(判断题)7:状态机能够分为:米里型和摩尔型两类。
A:错误
B:正确
正确答案:
(判断题)8:VerilogHDL数据类型是用来表示数字电路中物理连线、数据存放和传输单元等物理量。
A:错误
B:正确
正确答案:
(判断题)9:PLA是ProgrammableLogicArray,可编程逻辑阵列缩写。
A:错误
B:正确
正确答案:
(判断题)10:数字设计流程中采取原理图方式适合描述电路连接关系核接口关系。
A:错误
B:正确
正确答案:
(判断题)11:采取原理图方式数字设计可重用性、可移植要差一些。
A:错误
B:正确
正确答案:
(判断题)12:VerilogHDL语法要素与软件编程语言(如C语言)是完全相同。
A:错误
B:正确
正确答案:
(判断题)13:混合仿真器就是能同时支持Verilog和VHDL仿真器。
A:错误
B:正确
正确答案:
(判断题)14:用状态机进行设计具备速度快、结构简单、可靠性高等优点。
A:错误
B:正确
正确答案:
(判断题)15:数字设计流程中设计输入表示方式通常有原理图方式和HDL文本方式两种。
A:错误
B:正确
正确答案:
(判断题)16:把适配后生成编程文件装入到PLD器件中过程称为下载。
A:错误
B:正确
正确答案:
(判断题)17:行为描述就是对设计实体数学模型描述,其抽象程度远高于结构描述。
A:错误
B:正确
正确答案:
(判断题)18:PLD按照可编程次数分为两类:一次性编程器件和可数次编程器件。
A:错误
B:正确
正确答案:
(判断题)19:仿真也称模拟,是对所设计电路功效验证。
A:错误
B:正确
正确答案:
(判断题)20:VerilogHDL中整数型常量是不能够综合。
A:错误
B:正确
正确答案:
(判断题)21:VerilogHDL不支持逻辑运算符。
A:错误
B:正确
正确答案:
(判断题)22:在IC设计领域中,IP核通常完成
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