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1.1半加器1.2全加器1.3多位数加法器
由真值表写出输出逻辑函数表达式：1.1半加器如果不考虑来自低位的进位将两个1位二进制数相加，称为半加。实现半加运算的电路叫做半加器。真值表逻辑图逻辑符号
1.2全加器不仅考虑两个一位二进制数Ai和Bi相加，而且还考虑来自相邻低位进位数Ci-1，这种运算称为全加。实现全加运算的电路叫做全加器。真值表
由真值表写出函数表达式：1.2全加器逻辑图逻辑符号
（1）串行进位加法器两个多位数相加时每一位都是带进位相加的，因而必须使用全加器。只要依次将低位全加器的进位输出端接到高位全加器的进位输入端，就可以构成多位加法器了。1.3多位数加法器例如：4位串行进位加法器优点：电路结构比较简单，在对运算速度要求不高的设备中，这种加法器仍不失为一种可取的电路。缺点：运算速度慢。
（2）超前进位加法器为了克服串行加法器运算速度慢的缺点，产生了超前进位加法器。其主要设计思想是设法将高位的进位输入信号Ci经判断直接给出。1.3多位数加法器常用的超前进位加法器有54/74HC283、54/74LS283、4008B等。与串行进位加法器比较，超前进位加法器运算时间的缩短是以电路复杂程度为代价而换取的。
（3）加法器的应用加法器除了能够进行二进制数的算术运算之外，在有些场合还被用作实现组合逻辑函数。1.3多位数加法器[例5-1]设计一个代码变换电路，将8421BCD码转换为余3码。解：根据余3码的编码规律，对应于同一十进制数，余3码Y3Y2Y1Y0总是比8421BCD码DCBA多0011（即十进制的3），故有Y3Y2Y1Y0=DCBA+0011
课堂练习试设计一个全减器电路，输入有被减数A、减数B、低位来的借位数C（它们都是一位二进制数），输出为差D及向高位送出的借位数E。
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