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21.8.1半加器半加：实现两个一位二进制数相加，不考虑来自低位的进位。AB两个输入表示两个同位相加的数两个输出SC表示半加和表示向高位的进位逻辑符号：半加器：COABSC?第94页，共139页，星期日，2025年，2月5日半加器逻辑状态表ABSC0000011010101101逻辑表达式逻辑图=1..ABSC第95页，共139页，星期日，2025年，2月5日21.8.2全加器输入Ai表示两个同位相加的数BiCi-1表示低位来的进位输出表示本位和表示向高位的进位CiSi全加：实现两个一位二进制数相加，且考虑来自低位的进位。逻辑符号：全加器：AiBiCi-1SiCiCO?CI第96页，共139页，星期日，2025年，2月5日(1)列逻辑状态表(2)写出逻辑式AiBiCi-1SiCi0000000110010100110110010101011100111111第97页，共139页，星期日，2025年，2月5日逻辑图=11AiCiSiCi-1Bi半加器构成的全加器1BiAiCi-1SiCiCO?CO?第98页，共139页，星期日，2025年，2月5日21.9编码器把二进制码按一定规律编排，使每组代码具有一特定的含义，称为编码。具有编码功能的逻辑电路称为编码器。n位二进制代码有2n种组合，可以表示2n个信息。要表示N个信息所需的二进制代码应满足2n?N第99页，共139页，星期日，2025年，2月5日21.9.1二进制编码器将输入信号编成二进制代码的电路。2n个n位编码器高低电平信号二进制代码第100页，共139页，星期日，2025年，2月5日(1)分析要求：输入有8个信号，即N=8，根据2n?N的关系，即n=3，即输出为三位二进制代码。例：设计一个编码器，满足以下要求：(1)将I0、I1、…I78个信号编成二进制代码。(2)编码器每次只能对一个信号进行编码，不允许两个或两个以上的信号同时有效。(3)设输入信号高电平有效。第101页，共139页，星期日，2025年，2月5日001011101000010100110111I0I1I2I3I4I5I6I7(2)列编码表：输入输出Y2Y1Y0第102页，共139页，星期日，2025年，2月5日(3)写出逻辑式并转换成“与非”式Y2=I4+I5+I6+I7=I4I5I6I7...=I4+I5+I6+I7Y1=I2+I3+I6+I7=I2I3I6I7...=I2+I3+I6+I7Y0=I1+I3+I5+I7=I1I3I5I7...=I1+I3+I5+I7第103页，共139页，星期日，2025年，2月5日YA(3)应用“与非”门构成“非”门电路(4)用“与非”门构成“或非”门YBA由逻辑代数运算法则：第62页，共139页，星期日，2025年，2月5日例1：化简2.应用逻辑代数运算法则化简（1）并项法例2：化简（2）配项法第63页，共139页，星期日，2025年，2月5日例3：化简（3）加项法（4）吸收
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