基于Verilog串口通信模块调用与实现说明.pdfVIP

基于Verilog串口通信模块调用与实现说明.pdf

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Thisisanexampleofcallingtheuart_xmoduleforserialporttransmission.Learnhowtocallthisserialport

transmissionmoduletoachievefastserialporttransmission.Fordetailedexnationsofuart_x,pleaserefer

totheexnationdocumentundertheuart_x_okfolder.

逐句解释:

1-2:文件包含。主要包含一个分频模块和一个串口发送模块。

4-16:端口列表:Resetb-复位信号,高电平复位;Clkin-40M输入时钟;Txd-串口发

送端口。

17-18:端口输入输出。

27-33:变量。XmitPlus-发送启动脉冲,连接到uart_x模块里;TxData-待发送数据,

连接到uart_x模块里;TxFinish-发送完毕信号,连接到uart_x模块里;TxClk-

发送波特率时钟,由Clkin分频得来,连接到uart_x模块里;ByteCnt-发送字节

计数器,在该程序里要循环发送10个字母,所以用这个变量来计数;Cnt-计数

器,用它的值形成一个小的状态机。

25-36:分频模块调用。形成174×2=348分频,得到115200bpsd的波特率时钟。

38-39:串口发送模块调用。

41-72:通过一个always语句,向串口发送模块uart_x循环发送a-j10个字母。

42-47:异步复位。清两个计数器ByteCnt和Cnt,并把发送脉冲XmitPlus置0。

48-71:通过变化的Cnt值,构成一个小的状态机。

50:用Cnt计数每一个TxClk的上升沿

51-71:case语句判断Cnt的值,并作相应的动作

52-56:置高启动脉冲XmitPlus,并把发送数据TxData递增。这样uart_x

Exinsentencebysentence:

1-2:Filecontains.Itmainlyincludesafrequencydivisionmoduleandaserial

portsendingmodule.4-16:Portlist:Resetb-resetsignal,highlevelreset;

Clkin-40Minputclock;Txd-serialportsendingport.17-18:Portinputand

outputdeclaration.27-33:Variabledeclaration.XmitPlus-Sendstartpulse,

connectedtotheuart_xmodule;TxData-tobesent,connectedtotheuart_x

module;TxFinish-Sendsignal,connectedtotheuart_xmodule;TxClk-Send

baudrateclock,obtainedbyClkinfrequencydivision,connectedtotheuart_x

module;ByteCnt-Sendbytecounter,10lettersaresentincycinthis

program,sousethisvariab

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