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中国电子学会敏感技术分会第十六届电压敏学术年会论文专刊
基压敏陶瓷电性能的影响
徐宇兴1,张中太2,唐子龙2。李雄佳2
1中国科学院过程工程研究所北京100190
2清华大学材料系新型陶瓷与精细工艺国家重点实验室北京100084
摘要:
瓷电性能的影响,分析了其压敏机理。研究得到少量的受主掺杂剂和助烧剂对样品的晶粒尺寸和压敏电压影响规律及对
8.5V.mm~,Ⅱ=1.6~2.4,C=170~3457nF,Tan6=1.2~5.8%。通过研究获得了受主掺杂剂和助烧剂的最佳配比:
比Co,=1.Omo阮,MnCO,=0.05mo隅,AST=O.3wt%,CeO,=O.1%。
关键诩: (Sr,Ba,Ca)Ti03,压敏陶瓷,睢Mn—AST—Ce掺杂,电性能
1引言 2实验与测试
srTi0,基压敏电阻是一种典型的具有电容一压敏复合
2.1样品制备
功能的陶瓷元件。该类材料具有较高介电常数和很小的介
采用分析纯的S以0,,Bac0,,cac0,和Ti02为初始原料,
电损耗,其中,高介电常数可以起到高频滤波的作用。不
其具体配方组成按照(Sro38Bao.34Ca0
仅如此,SrTi0,基压敏电阻还具有优良的非线性伏安特性,
即在某一临界电压以下,其电阻值很高,几乎是绝缘体,
元素的引入通过加入Li:c0,和MncO,实现。AsT则为适量
但是当超过这一临界电压时,电压的少量增加就会引起电
Al:0,,si0:和Ti0:的混合物。制备过程中按比例称量配料,
阻的急剧减小和电流的急剧增大,该特性可以有效地消除
加入旄主掺杂剂Nd20;和l丑20,,经湿法球磨6h,烘干,过
过压尖脉冲的影响,因此srTi0,基压敏电阻被广泛应用于
筛,预烧后,再加入受主杂质Li:co,和Mnco,以及适量的
消除噪声、浪涌电压吸收等抗干扰电路”。21。
Al:0,、Si0:、Ti0:和ceO:等助熔改性剂,经二次配料,湿
目前,在微型电机、移动通讯等大多采用低压集成电
法球磨8h。烘干,过筛。加5%PVA造粒,在150MPa压
路的低压应用领域,对于SrTiO,基压敏材料,通过改进配
力下压成直径10mm,厚度为1~2mm的环形素坯,将其在
方,制得具有低压敏电压V。。高压敏非线性系数a、高表
900cC排胶后送入气氛炉内,在还原气氛(N::H:=1:3,体积
观介电常数£r和低介电损耗t驴的压敏陶瓷材料,一直是研 比)中于1370。c烧结,以实现晶粒半导体化。将烧成后的
究者们研究的热点。而srTi0,基压敏电阻之所以被广泛应
样品在空气气氛中进行氧化热处理使晶界层绝缘化。
用,其最重要的原因之一就是因为其具有优良的非线性伏 本文所研究的“一Mn—AsT—ce掺杂的正交实验因素水
安特性和介电特性。为了进一步改善和提高其非线性伏安
平如表l所示。
特性和介电特性,本文研究了“一Mn—AST㈨203,si02,Ti0:)一
ce掺杂对(Sr,Ba,ca)Ti0,基压敏陶瓷电性能的影响,分析2.2样品测试
了其压敏机理,并通过研究获得了受主掺杂剂和助烧剂的 将氧化热处理后样品的表面烧渗Ag电极,然后在
最佳配比。
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