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SMT常用的工艺流程:
纯表面组装工艺流程:
1.1单面组装工艺流程:
印刷锡膏 元器件贴装 回流焊接
二、SMT表面组装技术常用元器件:
矩形片状元件 rectangular chip component :
两端无引线,有焊端,外型为薄片矩形。
圆柱形表面组装器件 MELF :
两端无引线,有焊端的圆柱形表面贴装器件。
小外形封装 small outline package (SOP) :
小外形模压塑料封装,两侧具有翼形或J形引线的封装形式。
小外形三极管small outline transistor(SOT):
采用小外形封装的晶体管。
小外形二极管small outline diode(SOD):
采用小外形封装的二极管。
小外形集成电路small outline IC (SOIC):
指外引脚数不超过28脚的小外形集成电路,一般有宽体和窄体两种,其中翼形引线称SOL,J形引线称SOJ。
收缩型小外形封装 shrink small outline package (SSOP):
近似小外形封装,但宽度比小外形封装窄。
芯片载体 chip carrier
表面组装集成电路的一种基本封装形式,它是将集成电路芯片和内引线封装于塑料或陶瓷壳体之内,向壳外四边引出相应的焊端或短引线;也泛指采用这种封装的表面组装集成电路。
塑封有引线芯片载体 plastic leaer chip carrier (PLCC):
四边具有J形短引线,典型间距为1.27mm,采用塑料封装的芯片载体,外型有正方形和矩形两种。
四边扁平封装器件 qual flat package (QFP):
四边具有翼形短引线,间距有1.00、0.80、0.65、0.50、0.40、0.30 mm 。
无引线陶瓷芯片载体 leadless ceramic chip carrier (LCCC):
四边无引线,有金属化焊端并采用陶瓷气密封装的表面组装集成电路。
微型塑封有引线芯片载体 miniature plastic leaded chip carrier
四边有翼形短引线,封装外壳四角带有保护引线共面性。典型引脚间距为0.63mm。
有引线陶瓷芯片载体 leaded ceramic chip carrier (LDCC)
近似无因县陶瓷芯片载体,它把引线封装在陶瓷基体四边上,使整个的
热循环性能增强。
三、常用术语:
翼形引线:从表面组装元器件封装体向外伸出的形似鸥翅的引线。
J形引线:从表面组装元器件封装体向外伸出并向下伸展,然后向内弯曲,形似英文字
母“J”。
I型引线:从表面组装元器件封装体向外伸出并向下弯曲90度,形似英文字母“I”。
引脚间距:从表面组装元器件相邻引脚中心线之间的距离。
5.细间距器件:引脚间距不大于0.65mm的表面组装元器件,
6.引脚共面性:指表面组装元器件引脚的垂直高度偏差,即引脚的最高脚底与最低三条引
脚的脚底形成的平面之间的垂直距离。其值一般不大于引脚厚度;对于细间距器件,其
值不大于0.1mm。
四、锡膏:
锡膏粘度:
印膏方法 丝网印刷 漏板印刷 注射滴涂 粘度 300-800 普通SMD:500-900
细间距SMD:700-1300 150-300 焊剂类型:
RMA(中等活动)焊剂、RA(全活性)、免清洗焊剂。
粒度:对于细间距的元器件,锡膏中的金属粉末粒度应更细。
四种粒度等级锡膏
类型 小于1%颗粒尺寸 至少80%颗粒尺寸 最多10%颗粒尺寸 1
2
3
4 >150
>75
>45
>38 75-150
45-75
20-45
20-38 <20
<20
<20
<20 锡膏印刷工艺
一般情况下,焊盘上单位面积的锡膏量应为0.8mg/mm2,对细间距的元器件应为0.5mg/mm2。
锡膏覆盖每个焊盘的面积应在75%以上。
锡膏印刷后,应无严重塌漏,错位不大于0.2mm,对细间距错位不大于0.1mm。
工艺参数:
刮板硬度:硬度60-90HS(肖氏硬度),一般为70HS。
刮板形状:平型、菱型、角型。
刮印角度:40-70度。
印刷间隙:网版或漏板与印制板的间隙控制在0-2.5mm。
印刷压力:网版3.5*105Pa,漏板1.75*105Pa。
印刷速度:10-25mm/s。
影响锡膏特性的重要参数:
粘度:粘度是焊膏的主要性能指标,影响焊膏粘度的主要因素为合金焊料的含量、锡膏颗粒的大小、温度和触变剂的润湿性能。
锡膏颗粒的形状、大小和分布:锡膏颗粒形状可分为球形和其它形状,球形颗粒具有良好的印刷性、有相对小的表 面积、含氧量低,因此能保证较好的焊接质
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