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流水线的性能 通过更加复杂的流水线和动态调度开发隐形（implicit）指令级并行性 乱序执行执行，同时保证： 真数据相关(RAW) 精确中断 通过寄存器换名，消除WAR和WAW冒险 重排序缓冲器（Reorder buffer）保存尚未提交（committing）但已完成的结果，以支持精确中断 频繁出现的转移指令会产生控制冒险，从而限制性能的改进 指令流水线的总体结构 控制流导致的性能损失 MIPS的转移和跳转 深度指令流水线中的转移损失 降低转移损失 转移预测 静态转移预测 动态转移预测learning based on past behavior 转移预测位Branch Prediction Bits 转移历史表Branch History Table 开采转移的空间关联Yeh and Patt, 1992 两级转移预测器 BHT局限性 转移目标缓冲器（Branch Target Buffer） 地址冲突（Address Collisions） BTB仅对控制指令有效 Branch Target Buffer (BTB) 在译码前查询BTB 合并BTB和BHT 相对BHT而言，BTB的表项的实现成本更高，但是可以在流水线较早的时候就对取指流进行重定向，并能够加速间接转移(JR) BHT可以包含更多的表项，并更加准确 跳转寄存器(JR)的使用 切换状态 (jump to