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低延遲觸發器電路
授課老師：陳瑞堂 老師
學生：邵志強
Outline
摘要............................03
Claims.04.05.06.07.08.09
專利分析.....................10
突破方式.....................10
結論.............................10
參考資料.....................10
摘要
一個觸發器電路包括一個預充電在第一個節點發生的第一階段的定時信號的預充電電路，放電電路和有條件履行取決於一個定時信號的第二階段發生在第一個節點響應後一個數據??輸入信號。觸發器電路進一步包括電壓保持電路，如閂鎖，配置存儲期間至少有部分的定時信號的第二階段後，在第一個節點一個邏輯值取決於保留的邏輯值，並輸出電路配置產生一個輸出信號取決於數據輸入信號後。第一個節點是保留的邏輯值，無論在第一邏輯狀態，可配置為驅動輸出電路輸出信號，可配置為驅動器後保留的邏輯值取決於輸出信號的邏輯狀態收費是第一個節點。
Claims
1.電子電路包括：預充電電路，配置到預充電的第一階段的定時信號發生在第一個節點;有條件履行第二階段的時機發生在第一個節點配置一個放電電路信號取決於數據輸入信號的電壓保持電路配置存儲保留的邏輯值，它取決於一個邏輯值在第一個節點，在至少一個定時信號的第二階段的一部分，其中電壓保持電路包括門鎖電路和延遲電路耦合之間的第一個節點和門鎖電路的輸入和輸出電路配置為產生一個輸出信號。
2.如請求項 1 電子電路，其中定時信號是時鐘信號。
3.如請求項 1 電子電路，其中，預充電電路由一個PMOS晶體管加上一個電源電壓節點和第一個節點，並加上門收到定時信號?。
4.如請求項 1 電子電路，其中包括多個串聯耦合晶體管之間的第一個節點，第一個電源電壓節點，其中一個是耦合到接收數據的多個晶體管的第一台晶體管的柵極輸入信號。
5.如請求項 4，其中的多個晶體管的第二晶體管的柵極耦合到接收時序信號，其中第三晶體管的多個晶體管的柵極耦合到接收延遲的版本定時信號。
6.如請求項 5，其中，預充電電路包括一個第四晶體管之間的第一個節點和第二電源電壓節點，其中第四個晶體管的柵極耦合到接收時序?信號。
7.採集電路，包括一個門將的電路配置存儲邏輯值的第一個信號指示?。
8.捕獲電路是一個鎖存電路。
9.一個延時電路耦合到接收時鐘信號和配置提供延遲以生產延遲的時鐘信號的時鐘信號?。
10.一個集成電路，其中包括：一個功能單位，配置為執行一個或多個邏輯功能的集成電路，其中的功能單元包括多個配置存儲相關的數據與邏輯功能的觸發器電路，其中每個觸發器電路包括：?預充電電路配置在發生的第一階段的定時信號預充電放電的電路配置，有條件放電在第二階段的定時信號發生取決於數據輸入的第一個節點的第一個節點;?信號;配置存儲保留的邏輯值取決於期間至少部分的定時信號的第二階段的第一個節點一個邏輯值時，其中電壓保持電路的電壓保持電路包括一個閂鎖電路和延遲之間的第一個節點和閂鎖電路的輸入耦合電路和配置產生一個輸出信號，取決於數據輸入信號，其中配置為驅動輸出電路是在第一個邏輯狀態的輸出信號輸出電路出院的第一個節點是不管保留的邏輯值，其中配置為驅動的依賴後保留的收費是邏輯值，當第一個節點在邏輯狀態的輸出信號輸出電路，其中輸出電路包括一個與非門加上第一個輸入的第一個節點，第二個輸入電壓保持電路耦合到接收保留的邏輯值。
11.集成電路作為其中預充電電路由一個PMOS晶體管加上一個電源電壓節點和第一個節點，並加上門收到定時信號。?
12.集成電路中放電電路包括多個系列加上額外的晶體管之間的第一個節點和一個接地參考節點，其中第一台晶體管的多個額外的晶體管的柵極耦合到接收數據輸入信號。
13.數據存儲電路，包括：預充電晶體管之間的第一個電源電壓節點和第一個節點，其中預充電晶體管配置為預充電的過程中第一階段的時鐘信號的第一個節點之間的第一個節點，再加上一個放電電路第二電源電壓的節點，其中的放電電路包括第一NMOS晶體管柵耦合到接收時鐘信號，第二個NMOS晶體管耦合到接收數據輸入信號門，和第三NMOS晶體管，加上門接收延遲的時鐘信號，接收和存儲邏輯值，它是依賴於在第二階段的時鐘信號的第一個節點的電壓閂鎖電路耦合;第一個輸入的第一個節點，並加上一個非門第二個輸入耦合到接收鎖存電路的存儲邏輯值?。
14.數據存儲電路包括多個逆變器的耦合到接收時鐘信號和進一步耦合系列提供時鐘信號延遲的第三個NMOS晶體管，其中多個逆變器由逆變器 的奇數16。
15.數據存儲電路中第二電源電壓節點地面節點。
16.數據存儲電路中放電電路配置為放電的第一個節點，只有當第二NMOS晶
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