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第四章 运算器;4.1 运算器的组成与功能 ;◇功能：实现二进制数据的算术、逻辑运算 算术运算—加、减、乘、除等 逻辑运算—与、或、非、移位等 ◇组成：由ALU、控制线路、多路选择器、 移位器等组成;;二、寄存器组;▲ 在运算器中用来提供一个操作数并存放运算 结果的通用寄存器称作为累加器。;2、专用寄存器;程序状态字PSW(Program Status Word)，它 存放着指令执行结果的某些状态；如是否溢 出、是否为零、是否有进位/借位、是否为负 等。它对程序员是开放的。;OF;三、控制逻辑;（4）逻辑图 用与非门;用异或门;2、 全加器;●设计步骤： （1）输入变量A i，B i — A、B两个数的第 i 位。 C i-1 — 来自低位的进位。 输出变量S i — 本位数和。 C i — 向相邻高位进位数。;（2）真值表 Ai Bi Ci-1 Si Ci 0 0 0 0 0 0 0 1 1 0 0 1 0 1 0 0 1 1 0 1 1 0 0 1 0 1 0 1 0 1 1 1 0 0 1 1 1 1 1 1;（3）化简;（4）表达式;四位并行相加串行进位加法器; 以上加法器可以实现多位二进制的并行 加法，即各相应位同时进行加运算，但进位 要逐位形成，高位的进位依赖于低位进位的 生成和传递，最高位进位要等待最低位进位 经历各位后才生成，这种产生进位的方法称 为“串行进位”。;为了减少进位延迟时间，引入了“先行进位”的概念， 其特点是n级加法器各级进位信号同时形成，故又称 为“并行进位”或“同时进位”。; ① 当本位Ai 和Bi 两数均为1时，将产生进位Ci ，称 “本地进位”。;当Pi=1时，可以使从i –1位来的进位通过第 i 位传递 到下一位。 公式：;由此，可递推出各位进位直接与C0 的关系：;（1） 组内并行，组间串行;（2）组内并行，组间并行;三、 ALU运算部件——74181;74181ALU方框图;逻辑功能表;74181ALU说明;1．ALU实现加法操作的原理;2．ALU单元实现逻辑运算;用四片74181构成的16位ALU;4.2.2 补码定点加减法运算 ; 当补码加减运算的结果不超出机器范围时，有 以下的运算规则： （1）参加运算的两个操作数均用补码表示。 （2）符号位作为数的一部分参加运算。 （3）求差时将减数求补，用求和代替求差。 （4）运算结果为补码。 （5）符号位的进位为模值，应该丢掉。;一、补码定点加法运算;例1：已知A=+0.10011， B=+0.01001，求A+B。;例2：已知A=10101，B=-11010；求 A + B 设字长n=6。;例3：设 A = 0.1011，B = – 0.0101，求 [A + B]补;二、补码定点减法运算;例5： A = + 0.1101，B = + 0.0110；求 A －B;例6： 已知[A]补=01001，[B]补=11100 ； 求[A+B]补， [A-B]补。;例7：设机器数字长为 8 位（含 1 位符号位） 且 A = 15， B = 24，用补码求 A – B;练习 ： 设机器数字长为 8 位（含 1 位符号位） 且 A = – 97，B = +41，用补码求 A – B;◆ 实现补码加、减法运算的逻辑电路;0，加（ADD）操作 1，减（SUB）操作;三、 数据溢出及检测 ;例8: A＝＋0.1011, B＝＋0.1001, 求A＋B。;例9: A＝＋0.1011，B＝＋0.0010，求 A＋B。;例10: A＝－0.1101, B＝－0.1011, 求 A + B。;例11： A＝－0.1101， B＝－0.0010，求A + B 。;练习1：已知[A]补=01010，[B]补=01010，求[A+B]补;产生“溢出”的原因：;溢出判断方法：;带溢出检测电路的补码加法器;2、一位符号位判溢出 参加操作的 两个数（减法时即为被减数和“求补”以 后的减数）符号相同，其结果的符号与原操作数的符号 不同，即为溢出。;3、 两位符号位判溢出;例12： A = +0.1100，B = +0.1000，求 A＋B。;例1