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第21章 触发器和时序逻辑电路 21.1 双稳态触发器 21.1.1 RS 触发器 21.1.2 JK触发器 21.1.4 触发器逻辑功能的转换 21.2 寄存器 21.2.1 数码寄存器 21.2.2 移位寄存器 21.3 计数器 21.3.1 二进制计数器 四位二进制同步加法计数器级间连接的逻辑关系 例: 分析图示逻辑电路的逻辑功能,说明其用处。 设初始状态为“000”。 2.列写状态转换表，分析其状态转换过程 21.3.2 十进制计数器 逻辑功能及外引线排列 逻辑功能及外引线排列 逻辑功能及外引线排列 21.3.4 环行计数器 21.3.5 环行分配器 21.4 555定时器及其应用 1. 由555定时器组成的多谐振荡器 2. 由555定时器组成的单稳态触发器 2. 由555定时器组成的单稳态触发器 2. 由555定时器组成的单稳态触发器 21.5 应用举例 应用2：抗干扰的定时电路 在工业控制中，周围环境往往存在大量的干扰信 号产生，如高频火花、电磁波、继电器的开关，必须 要提高控制所用的定时电路的抗干扰能力。 21.5.1优先裁决电路 工作原理： 开始比赛时，按下复位开关S。 0 0 1 不亮 不亮 1 1 0 0 未比赛时A1， A2为“0”复位开关S断开。 工作原理： 0 0 不亮 不亮 1 1 0 0 1 优先到达 0 1 1 亮 0 0 0 1 封锁 封锁 保持不变 21.5.2 四人抢答电路 CT74LS175 外引线排列图 　　四人抢答电路的主要器件是 CT74LS175 型四上升沿 D 触发器，其外引线排列图如右图，它的清零端 和时钟脉冲CP是四个 D 触发器共用的。 　　抢答前先清零, Q4 ~ Q1 均为0, 相应的发光二极管 LED 都不亮； ~ 均为 1, 与非门G1的输出为 0，扬声器不响。同时，G2 输出为 1，将 G3 打开，时钟脉冲 CP 经过 G3 进入 D 触发器的 CP 端。此时，由于 S1 ~ S4 均未按下, D1 ~ D4 均为 0, 所以触发器的状态不变。 工作原理： 21.5.2 四人抢答电路 工作原理：抢答前清“0” 0 0 0 0 截止 0 若S1首先被按 下,D1和Q1 均变为 1, 相应的发光二 极管亮； 变为0, G1的输出为1, 扬 声器响。同时, G2 输出为0, 将G3 封 闭, 时钟脉冲CP 便不能经过G3 进 入 D 触发器。由 于没有时钟脉冲, 因此,再按其它按 钮,就不起作用了, 触发器的状态不 会改变。 抢答开始，若S1先被按下 1 0 0 0 亮 0 1 导通 响 0 封锁 1 1 1 1 1 六进制计数器 计数器清零 七进制计数器 当出现 0110(6)时，应立即使计数器清零，重新开始新一轮计数。 RD = QC QB。 当出现 0111(7)时，计数器立即清零，重新开始新一轮计数。RD = QC QB QA 。 计数器清零 . 二片74LS290构成100以内的计数器 例1：二十四进制计数器 二十四分频输出 . 0010(2) 0100(4) 十位 个位 两位十进制计数器(100进制) RD = 2Q1 ·1Q2 例2: 六十进制计数器 个位为十进制，十位为六进制。个位的最高位 Q3 接十位的 CP0 ，个位十进制计数器经过十个脉冲循环 一次，每当第十个脉冲来到后 Q3由 1 变为 0，相当于 一个下降沿，使十位六进制计数器计数。经过六十个 脉冲，个位和十位计数器都恢复为 0000。 二-五-十进制计数器 二进制 RD高电平清零 五进制 五进制 每个芯片内 有两个十进制 计数器 每个计数器 包含一个二进 制和一个五进 制计数器。 二进制和五 进制经适当联 接可组成十进 制计数器 下降沿翻转 十位 0100(4) 个位 0110(6) 计数脉冲 十位 个位 两位十进制计数器（100进制） 例：用一片74LS390构成四十六进制计数器 D (DOWN) — 减法脉冲输入端 U(UP) — 加法脉冲输入端 L(LOAD) — 置数端 CO — 进位端 BO — 借位端 C(CLR) — 清零端 74LS192外引线排列图 74LS192功能表 ? 1 1 0 ? 加 计 数 ? ? 0 0 D0~D3 置 数 1 1 1