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基于ADSP―BF537多路数字音频集采技术研究 　　摘 要：近年来，随着电子信息及计算机技术的飞速发展，数字电路在多种行业及领域内逐渐广泛应用，对数字电子设计的要求不断提高。本文针对基于ADSP-BF537的数字音频信号集采技术进行论述，对输入信号的解码和信号质量的监测作为音频信号采集处理模块的任务，通过自动倒换程序来切换符合要求的信号。 　　关键词：集采技术；数字音频；多路集采 　　1 音频集采的概述 　　数据集采及处理系统中，主要的硬件电路包括：微型计算机、调理信号电路、数据集采电路。调理信号电路主要完成对外部信号的预处理工作，以达到数据集采电路对动态范围的要求。在数字电路应用设计中，音频集采电路部分完成的主要功能如下：及时应答通信和控制模块的查询，并对音频信号进行采集、解码及处理。音频集采模块在设计时，和其他模块一起部属在音频处理机箱中，对输入信号源进行数据采集、解码，并对信号质量实施监测；信号切换通过自动倒换程序来完成，达到相关联模块对传输信号的要求，然后通过串行传输将转换后的信号到音频输出模块。音频输出模块再通过RS-232串口与通信控制模块进行互连，这一阶段会把接收到的转换信号扩展为两路信号，分别作为监视及输出音频信号，输出到终端处理模块。 　　2 数据处理部分设计 　　数字电路的框架结构图如下： 　　在基于ADSP-BF537的多路数字集采设计中，对数据的处理电路设计，采用ADSP-BF537作为核心芯片，主要完成两方面的工作：与通信控制模块进行数据交互；初始化音频信号解码芯片。 　　ADSP-BF537具有很多优点：如强大的多媒体数据处理能力，接口丰富，价格低廉，性能良好等。不仅适合应用于完成视频、音频、图像、语音和数据通信的数字信号处理方面，而且还能够提供综合的控制能力，可在网络化和流媒体、数字家庭娱乐系统、娱乐系统和车载通信、移动电视及数字广播等领域进行推广。 　　外围电路设计。ADSP-BF537主要使用的接口包括： SPORT、UART、SPI及片外存储器。由晶体振荡器为系统外部输入提供时钟，经过EPM128后从BF537的CLKIN引脚接入，其频率为24.576MHz。系统外设时钟及核时钟??最高频率分别为：133mHz、300mHz，在初始化后，外围时钟及核时钟均从CLKIN引脚获取原始时钟信号，编程使片上锁相环PLL倍频CLKIN信号，可选择1～63的倍频因子。为了确保系统的实时性，把内核时钟倍频到300mHz。 　　多路数字集采电路设计，主机和从机分别为：BF537芯片、3片CS8420。控制数据比特流方面：主机通过使能片选信号以及产生串行时钟信号SCK进行控制。从机接收到主机发来的数据，存入移位寄存器，同时通过数据发送线把需要传送的数据送出移位寄存器。采用广播模式时，一个主机可同时把数据移位到多个从机中。但是在从机向主机输出数据时，只有一个从机输出数据到主机；同样，多个从机可同时接收数据，但一次只能有一个从机向主机发送数据。BF537的SPI接口通过CPLD对CS8420进行初始化。BF537的一个SPI周期内最多发送16位数据，对CS8420的写操作BF537时，要发送2次数据，然后在CPLD内对片选信号进行修正。 　　每个SPORT都支持以下功能：独立发送和接收；允许多数据块时的DMA链操作；在处理器内核控制下，进行与片内存储器间的单字传送；提供DMA主机控制下的发送和接收；可对发送和接收的数据进行μ率和A率压扩；执行与片内存储器的DMA传送，每个SPORT能够自动完成对数据块的完整收发。 　　SPORT的操作过程：写SPORT的SPORTx_TX寄存器，使准备SPORT传送数据；TFS信号发起从高位或者地位开始传送数据。SPORT利用位时钟来标志每个数据位的起始，帧同步脉冲来标志数据包的开始。帧信号包括：发送、接收帧同步两种。 　　多路数据集采时，采用同步串口SPORT输出解析后的信号。3片CS8420芯片将3路输入的音频信号解析后送入CPLD，再由CPLD分时送入BF537的SPORT口。 　　3 音频信号解码芯片电路设计 　　数字信号具有传播失真小的优点，但是由于对这些信息处理方式及采样频率不同，给数字信号的处理带来不便。CS8420芯片（立体声数字音频采样频率转换器）作为一款非同步取样频率变换器，使得这些困难迎刃而解。它具有如下优点：带有AES3型和串行数字音频输入、输出；其声道状态和用户数据集成在区块划分的缓存器上，使得操作过程更简洁；输入数据完全与输出数据异步，输出数据可以与外部系统时钟同步。 　　信号进入板卡后，首先进入CS8420。CS8420为数字音频采样率转换器，提取AES3信号，并改变信号采样速率。CS8420由BF537从SPI接