第3章数字系统设计与VerilogHD.pptVIP

5. 将设计项目设置成工程和时序仿真 全加器工程f_adder的仿真波形 3.2 Quartus II的优化设置 1. Setting设置 在Quartus II软件菜单栏中选择“Assignments”中的“Setting…”就可打开一个设置控制对话框。可以使用Setting对话框对工程、文件、参数等进行修改，还可设置编译器、仿真器、时序分析、功耗分析等等。 Settings对话框 2. 分析与综合设置 Analysis Synthesis Settings项中包含有四个项目： VHDL Input Verilog HDL Input Default Parameters Synthesis Netlist Optimization 作为Quartus II的编译模块之一，Analysis Synthesis包括Quaruts II Integrated Synthesis集成综合器，完全 支持VHDL和Verilog HDL语言，并提供控制综合过程的选项。支持Verilog-1995标准（IEEE标准1364-1995）和大多数Verilog-2001标准（IEEE1364-2001），还支持VHDL1987标准（IEEE标准1076-1987）和VHDL1993标准（IEEE标准1076-1993）。 3. 优化布局布线