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中国科技论文在线
基于 Verilog HDL 的MAC 地址过滤设计与
仿真
1 2**
王艳梅 ,杨光永
5 (1. 暨南大学电子工程系,广州 510632;
2. 华南理工大学机械工程学院,广州 510640)
摘要:详细阐述了基于数字集成电路的 MAC 地址过滤 IP 核的设计方法和步骤。采用 verilog
HDL 硬件描述语言,设计了一款 MAC 地址过滤器 IP 核。该 IP 核引入了 hash 算法定位,
并提出了基于 hash 算法的多重比较器,提高了地址过滤的速率。
10 关键词:地址过滤;延时控制器;hash
中图分类号:TN46
Design and simulation of MAC Address Filtering Based on
Verilog HDL
1 2
15 WANG Yanmei , Yang Guangyong
(1. Department of Electronic and Engineering, Jinan University, GuangZhou 510632;
2. School of Mechanical Engineering South China University of Technology, GuangZhou 510640)
Abstract: Elaborate on the design methods and steps of MAC address filtering IP core based on
digital integrated circuits. This article used verilog HDL to design a MAC address filtering IP core.
20 The IP core introduced the hash algorithm localization, and proposed multiple comparators based
on the hash algorithm, which improved the speed of the address filtering.
Keywords: Address Filtering; delay controller; hash
0 引言
25 目前,提高网络传输速率的方法,主要是依靠提高路由器、交换机、网桥等的工作频率
和增加网络带宽[1] 。然而,当设备的工作频率提高到一定程度之后,码间串扰急剧恶化,从而
导致误码率上升。随着系统工作频率逐步提高,还会带来严重的电磁兼容问题。因此,通过
单纯提高设备工作频率的方法已经遇到进一步发展的瓶颈。在工作频率不变的情况下,如何
提高单位时间内的处理速度,成为提高网络吞吐量、降低传输时延、降低传输误码率的必行
30 之路,也是当前研究热点。
MAC 地址过滤模块是网桥的核心模块之一,其过滤的效率直接影响网络传输速率。传
统的地址过滤方法是通过循环比对来完成的,需要遍历整个地址列表空间,由于地址列表较
大,造成严重的网
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