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`timescale 1ns / 1ps
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// Company:
// Engineer:
//
// Create Date: 2016/03/28 22:19:17
// Design Name:
// Module Name: vga
// Project Name:
// Target Devices:
// Tool Versions:
// Description:
//
// Dependencies:
//
// Revision:
// Revision 0.01 - File Created
// Additional Comments:
//
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///////////////
module vga(
input clk,
input rst,
output reg hs,
output reg vs,
output [3:0] r,
output [3:0] g,
output [3:0] b
);
//maximum value for the horizontal pixel counter
parameter HMAX=10b1100100000; // 800
//maximum value for the vertical pixel counter
parameter VMAX=10b1000001101; // 525
//total number of visible columns
parameter HS_WIDTH=10b0001100000; //96
//HS pluse width
parameter HP=10b0000101000; //40
//H Back Porch
parameter HLB=10b0000001000; //8
//H Left Board
parameter LEFT_NO_DISPLAY_ZONE=HS_WIDTH+HP+HLB;
// horizontal and vertical counters
reg [9:0] hcounter=10b0000000000;
reg [9:0] vcounter=10b0000000000;
reg [11:0] color=12b000000000000;
// active when inside visible screen area.
wire video_enable ;
reg vidon;
assign r=color[11:8];
assign g=color[7:4];
assign b=color[3:0];
// increment horizontal counter at pixel_clk rate
// until HMAX is reached, then reset and keep counting
always @(posedge clk or posedge rst)
begin
if(rst)
begin
hcounter=10b0000000000;
hs=1;
end
else
begin
if(hcounter HMAX-1)
hcounter=10b0000000000;
else
hcounter = hcounter+1;
if(hcounter96)
hs=0;
else
hs=1;
end
end
//increment vertical counter when one line is finished
//(horizontal counter reached HMAX)
//until VMAX is reached, then reset and keep counting
always @(posedge clk or posedge rst)
begin
if(rst)
begin
vcount
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