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数字逻辑组合逻辑电路.ppt

数字逻辑组合逻辑电路.ppt

    假定门电路的延时时间为tpd。根据“与非”运算，“与非”门的输出端是由“1”变到“0”，再从“0”变到“1”。由于门电路有延时时间tpd，故输出值的变化滞后输入值tpd时间，如图3-30所示。图3-30门电路的延时第62页，共115页。1.组合逻辑电路中的竞争与险象组合逻辑电路是由门电路组合而成的，在组合逻辑电路中每一层的门电路个数和类型都不会相同，这就会出现一个现象，那即是当输入信号经过组合逻辑电路中间层门电路的逻辑运算后，到达第Ki层门电路输入端的时间不一致，这种现象称为竞争。 竞争可能导致第Ki层的输出端产

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