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Differential Pair Quick-Eye Analysis by SIwave + Designer/Nexxim 本文將示範從PADS PCB layout前處理，匯出.asc file to SIwave，在SIwave內設PCB堆疊與材質，選定nets與設port，檢查圖檔與設定模擬條件，匯出S-parameter，在Designer內使用Quick-Eye Analysis，完成整個模擬流程。 PCB預處理：Layout檢查、層面清理 1.1 Disable沒有用的層面：Setup \ Layer Definition 還必須檢查Plane Type的各層屬性是否正確：沒鋪銅的訊號層指定No Plane，有鋪銅的power/ground plane則要設定成Split/Mixed 1.2 Split/Mixed Plane設定：Tools \ Options \ Split/Mixed Plane 1.3 訊號層鋪銅：Tool \ Pour Manager \ Flood標籤 -- Flood All -- 按Start 1.4 Power/Ground層鋪銅：Tool \ Pour Manager \ Plane Connect標籤 -- Select All -- 按Start PCB Export：轉圖設定以及Export data (.asc file) Export .asc：File \ Export 2.1. 選擇所有項目匯出 2.2. SIwave (AnsoftLinks) Export只能支持到PADS 2005.2的格式 2.3. SIwave可以用[Basic]或[Current](官方操作手冊是用Current)，而PowerSI對於[Basic]支持比較好 SIwave Import .asc and save as .anf File \ Import \ Mentor PADS Design SIwave指定匯入.asc後，會自動跳一個另存.anf的視窗，只要輸入檔名與路徑，就會自動轉存一個.anf檔。 工作資料的路徑，不可有中文，否則SIwave與Design/Nexxim會抓不到 Validation check and clear error messages Tools \ Validation Check (SIwave v5.0) 如果Validation Check的結果有錯誤，要處理。 -- Self-intersecting Polygons Error，指的是PCB Tool自動鋪銅後，有些地方會有鋪銅不完整的情況。從Error message所顯示的座標double-click即會跳到layout錯誤處，使用 Draw Rectangle 在merge mode ( )把縫隙補齊就可以。 請選擇Rectangle補鋪銅，不要選trace補，因為Ansoft視兩者的屬性是不同的，前者才是plane -- Disjoint Net Error。Nets \ Misalignment \ Select and view然後，選Correct即可更正。 -- Overlapping Nets，可能是有些Net沒拉好，修正或刪除即可。 -- Overlapping Vias把重疊的via刪除即可。　 　 Validation Check的Error message，有兩點需要注意的： 1. 其所顯示錯誤位置處的座標，是 採用使用者在做Validation Check當下的系統單位設定，所以要double-click讓軟體能正確指到layout錯誤處，必須把單位設定正確才可以 2. SIwave v3.5的Validation Check後面兩項的item，只顯示Error，而不提供錯誤位置座標的連結；而SIwave v4.0則全部check item都可提供錯誤位置的座標連結，並且還提供Auto Fix功能 Set layout Stack and layer materials 5.1 新增介質材料，並設定電介係數：Edit \ Materials \ [Dielectrics] Tab \ Add 介電係數是一個會隨頻率微量變化的參數。在SIwave v4.0與HFSS v11，都是把它定義成constant，但是SIwave v5.0與HFSS v12以後，就可以把介電係數 分高低頻設置。 5.2 修改Layer Stack：Edit \ Layer Stack(或按 ) SIwave v5.0起，還會考慮金屬電鍍表面的粗糙程度喔 5.3 Edit \ Trace Cross Section SIwave v5.0起