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2017-05-26 发布于重庆
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缓冲输入锁存输出.ppt

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缓冲输入锁存输出

* C,B,A:表示数据通道选通控制信号： C B A 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 选择关闭总线通道 C B A 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 关闭总线通道表示将数据开关上的数据输入到数据总线；表示将运算器结果发送到数据总线；表示将PC计数器的内容发送到数据总线；表示将寄存器R0的数据发送到数据总线；表示将寄存器R1的数据发送到数据总线；表示将寄存器R2的数据发送到数据总线；表示将移位寄存器的内容发送到数据总线；选择 A9,A8:表示片选信号： A9 A8 选通 0 0 0 0 1 1 1 1 选通CS0 选通CS1 选通CS2 选通CS3 缓冲输入/锁存输出实验实验一实验目的：掌握输入/输出的硬件电路实验要求：了解输入/输出的应用。数据收发器74LS245 74LS245是一种三态输出的8总线收发器。该收发器有16个双向传送的数据端，即A1－A8，B1－B8，另有两个控制端－使能端，方向控制端DIR，该芯片的功能见表。　74LS245 通常用于数据的双向传送、缓冲和驱动。　　74LS245 通常用于数据的双向传送、缓冲和驱动。 74LS273 74LS273是8位数据/地址锁存器　　74LS273是一种带清除功能的8D触发器， D1～D8为数据输入端，Q1～Q8为数据输出端，CLK—上升沿触发， CLRN—低电平清除（即当为低电平时，芯片被清除，输出全为0（低电平）），常用作8位地址锁存器。双二四译码器 74LS139 二-四译码器 74LS139真值表 1 1 1 1 0 1 1 1 0 1 1 1 0 1 1 1 0 1 1 1 X X 0 0 0 1 1 0 1 1 1 0 0 0 0 A B E Y3 Y2 Y1 Y0 选择使能输出输入 74LSl39为双二-四译码器，每个译码器仅有1个使能端E ，为低电平时选通；有2个选择输入对应4个译码器输出，输出低电平时有效。74LS139的逻辑功能真值见表。实验步骤：实验连线：位于实验装置中下方的CS1与/IOCS相连接用于片选74LS273，把位于实验装置左上方的C、B、A、A8、A9与位于实验装置左中央的对应控制信号对应连接。实验步骤：完成上述连接，仔细检查无误后方可进入本实验。在闪动的“P.”状态下按动增址命令键，使LED显示器自左向右第一位显示提示符“H.”,表示本装置已进入手动单元实验状态。实验步骤：数据开关三态门锁存器锁存输出 8位数据灯输出 CBA=001 A8=1 A9=0 按STEP *