数字电子技术-第四章组和逻辑电路.ppt

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2017-07-25 发布于湖北
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数字电子技术-第四章组和逻辑电路

第 4 章　组合逻辑电路 4.1　概　述一、组合逻辑电路的概念二、组合逻辑电路的特点与描述方法 4.2　组合逻辑电路的分析方法和设计方法一、组合逻辑电路的基本分析方法二、组合逻辑电路的基本设计方法 4.3　编码器一、编码器的概念与类型二、二进制编码器三、二－十进制编码器四、优先编码器 (即 Priority Encoder) 4.4　译码器一、译码的概念与类型二、二进制译码器三、二－十进制译码器四、数码显示译码器 4.5　数据选择器和数据分配器一、数据选择器和数据分配器的作用二、数据选择器的逻辑功能及其使用三、用数据选择器实现组合逻辑函数 4.6 加法器和数值比较器一、加法器二、数值比较器 4.7 组合逻辑电路中的竞争冒险一、竞争冒险现象及其危害二、竞争冒险的产生原因及消除方法本章小结 CT74LS138 组成的 4 线 – 16 线译码器工作原理　　E = 1 时，两个译码器都不工作，输出 Y0 ~ Y15 都为高电平 1。 CT74LS138(1) A2 A1 A0 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 STC STB STA Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 CT74LS138(2) A2 A1 A0 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 STC STB STA Y8 Y9 Y10 Y11 Y12 Y13 Y14 Y15 A2 A1 A0 E A3 1 低位片高位片 A3 A2 A1 A0 A2 A1 A0 A2 A1 A0 A2 A1 A0 STA 1 STB A3 STA STC STC STB E (1)A3 = 0 时，高位片不工作，低位片工作，译出与输入 0000 ~ 0111 分别对应的 8 个输出信号 Y0 ~ Y7 。 (2)A3 = 1 时，低位片不工作，高位片工作，译出与输入 1000 ~ 1111分别对应的 8 个输出信号 Y8 ~ Y15。　　E = 0 时，允许译码。　　将 BCD 码的十组代码译成 0 ~ 9 十个对应输出信号的电路，又称 4 线 – 10 线译码器。 8421BCD 码输入端，从高位到低位依次为 A3、A2、A1 和 A0 。 10 个译码输出端，低电平 0 有效。 4 线-10 线译码器CT74LS42逻辑示意图 Y1 Y0 Y3 Y4 Y2 Y5 Y6 Y7 Y8 Y9 A0 A1 A2 CT74LS42 A3 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 0 1 0 1 伪码 0 1 1 1 1 1 1 1 1 1 1 0 0 1 9 1 0 1 1 1 1 1 1 1 1 0 0 0 1 8 1 1 0 1 1 1 1 1 1 1 1 1 1 0 7 1 1 1 0 1 1 1 1 1 1 0 1 1 0 6 1 1 1 1 0 1 1 1 1 1 1 0 1 0 5 1 1 1 1 1 0 1 1 1 1 0 0 1 0 4 1 1 1 1 1 1 0 1 1 1 1 1 0 0 3 1 1 1 1 1 1 1 0 1 1 0 1 0 0 2 1 1 1 1 1 1 1 1 0 1 1 0 0 0 1 1 1 1 1 1 1 1 1 1 0 0 0 0 0 0 Y9 Y8 Y7 Y6 Y5 Y4 Y3 Y2 Y1 Y0 A0 A1 A2 A3 输出输入十进制数 4 线-10 线译码器 CT74LS42 真值表 0 0 0 0 0 0 1 0 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 1 1 0 1 0 1 0 0 0 1 0 1 1 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 0 1 1 0 0 1 1 1 1 0 1 0 1 0 1 伪码 0 1 Y A0 A1 A2 数码显示译码器译码器 Y Y Y Y Y Y 驱动器 Y Y Y Y Y Y Y A3 a 数码显示器 b